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NGC调用的问题
2012-12-27 21:54 5 3048
请教大家一个关于全局时钟的问题 attach_img
2012-12-27 21:45 8 3695
Verilog HDL建模技巧 :低级建模 仿顺序操作
2012-12-27 21:34 15 2375
[verilog] 为何选择Zynq-7000 All Programmable SoC
2012-12-27 21:33 1 2083
[Quartus] 基于SRAM的FPGA连线资源的一种可测性设计
2012-12-27 21:29 3 2608
基于FPGA嵌入式系统的雷达信号模拟器
2012-12-27 21:28 7 2149
我又来发问了 我想问一下 这两张图是什么意思? attachment  ...2
2012-12-27 21:27 22 3424
请教:verilog实现的UART模块中波特率的时钟分频问题……
2012-12-27 18:28 9 6263
可重构计算:高效灵活的计算技术
2012-12-27 18:14 9 2397
DVB-S射频调制的FPGA实现
2012-12-27 18:11 6 1768
可编程逻辑器件的分类及特点
2012-12-27 17:40 2 2252
在ZedBoard上运行linux之入门篇↑↑↑
2012-12-27 13:48 8 7737
modelsim 10.1a仿真出现内存加载失败,真想如图,怎么解决! attach_img
2012-12-27 11:01 3 1817
如何用VHDL判断电机转速达到匀速
2012-12-27 09:51 9 2318
改进能提高串口通信可靠性
2012-12-27 08:27 16 3410
FPGA设计的基本原则、技巧与时序电路设计
2012-12-27 08:23 12 2607
LTE基带目标设计平台方案详解
2012-12-26 22:44 5 1733
调试DDR2弹出的错误 attach_img
2012-12-26 22:42 5 3027
我与赛灵思的2012+原来是你
2012-12-26 22:24 2 2190
外包一个FPGA实现IDE(主机、从机)的项目  ...2
2012-12-26 15:11 24 4769
新手问:vhdl中,integer(n/2)是怎么用的?
2012-12-26 13:14 0 1678
ALTERA要放弃低端市场了吗?  ...2
2012-12-26 11:52 26 5051
ISE和MATLAB怎么连用
2012-12-26 10:53 8 8361
降低FPGA功耗的设计技巧
2012-12-26 10:28 1 2462
Virtex-5系统功耗设计的规则 attachment  ...2
2012-12-26 10:16 24 4068
VHDL状态机驱动两片74HC595遇到问题。
2012-12-26 09:56 2 2868
[VHDL] 用XilinxFPGA实现DDRSDRAM控制器 attachment agree
2012-12-25 23:47 4 2711
Xilinx FPGA设计约束的分类
2012-12-25 23:06 10 2956
[matlab] 我的ISE开始菜单中缺少很多工具
2012-12-25 21:08 15 2447
三个全新 Vivado 高层次综合应用指南
2012-12-25 18:03 1 1419
有没有用FPGA做过FM/FSK解调的?
2012-12-25 16:11 5 2651
[Quartus] Latency 究竟是多少? attach_img
2012-12-25 14:30 11 3219
如何结贴 attach_img
2012-12-25 11:49 5 2982
基于FPGA的毕业设计
2012-12-25 10:03 5 3246
求助!FPGA 除法 混合运算 attachment
2012-12-24 23:19 18 5560
FPGA设计的高速FIFO电路技术
2012-12-24 23:18 13 2290
FPGA在DSP领域的应用
2012-12-24 23:17 7 2132
[matlab] 纯小白在写作业,可是map过不去?报错啊。。。求助!!! attachment  ...2
2012-12-24 22:07 23 4078
maxplus 引脚配置后编译报错,求高手帮助,谢谢!
2012-12-24 22:01 2 2082
ALteral 的浮点除法IP 仿真
2012-12-24 22:01 1 1399
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