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达拉斯芯片的**?
2012-8-4 17:16 6 3750
[modelsim] Xilinx AccelDSP与System Generator的简单应用
2012-8-4 17:11 8 2784
同步写异步读
2012-8-4 10:57 10 2723
[CPLD] 在不用ISE软件的条件下,如何使用IMPACT软件烧写Prom  ...2
2012-8-3 23:23 30 9864
求教:cpld是否有专门接无源晶振的管脚?
2012-8-3 16:53 4 5059
大话FPGA喽 attachment
2012-8-3 16:16 18 3281
呃 安装了一个ISE13.1 问题来了(发牢骚) attachment  ...23
2012-8-3 07:47 50 7273
[CPLD] FPGA重复配置和测试的实现
2012-8-2 18:47 8 2426
基于FPGA+ARM的高速计算机屏幕信息记录系统
2012-8-2 18:47 5 2017
请教:ddr2内存的dqs信号 attachment
2012-8-2 18:47 15 6953
提高设计性能的 HDL 编码实践 attachment
2012-8-2 18:46 10 2320
FPGA设计中的边沿检测问题 attach_img
2012-8-2 18:43 4 2249
FPGA逻辑设计实验 attachment
2012-8-2 18:42 12 2680
[CPLD] Xilinx FPGA 内部结构深入分析 attachment
2012-8-2 18:42 4 2978
[Quartus] XILINX VIRTEX-5 FPGA 动态配置
2012-8-2 18:38 2 1924
版主看过来:A家资源和X家资源对应关系? attach_img
2012-8-2 16:49 9 2520
[CPLD] 程师分析实例,带你走近Xilinx FPGA设计  ...2
2012-8-2 16:03 20 4858
Xilinx_FPGA的时序分析指南英文 attachment
2012-8-2 15:57 6 2152
[CPLD] 基于ASIC+FPGA的IPv6路由器PoS接口设计
2012-8-2 13:30 12 3349
编辑掉
2012-8-2 10:23 1 1794
FPGA你必须知道的那些事儿 (转)  ...23
2012-8-2 09:52 41 7547
PLD/FPGA新手入门应该知道的知识
2012-8-2 09:45 6 2756
利用PCI局部总线实现BIade Server的数据交换
2012-8-1 23:50 10 2043
请教:关于verilog语法问题
2012-8-1 22:57 1 2048
[CPLD] FPGA设计中毛刺信号解析
2012-8-1 13:09 9 2117
modelsim仿真时st1和1有什么区别
2012-8-1 12:17 2 9316
verylog中的parameter使用
2012-8-1 11:28 0 2082
猴哥:sp6的封装和价格?
2012-8-1 11:27 3 2118
想自己做一个cable仿真器  ...2
2012-8-1 11:22 21 4023
求推荐一个FPGA型号
2012-7-31 17:31 12 3185
求spartan6的中文资料
2012-7-31 14:11 4 2213
我其实就是要一个硬件工程师来做FPGA开发,却。。。。
2012-7-31 08:53 19 5413
spartan6下周配置电路方式请教
2012-7-30 20:57 1 2300
Xilinx 申请开发板 猴哥
2012-7-30 17:13 2 2804
新手求教Serdes的Deterministic Latency模式 pattern信号与0xBC对不齐
2012-7-30 17:07 0 1776
QuartusII12.0自带的ModelSim不能用啊!! attach_img
2012-7-30 16:51 1 1860
FLEX10K配置问题 attach_img
2012-7-30 15:27 0 2420
赛灵思推出业界领先的 PCI 3.0硬模块和1866 Mb/s DDR3 解决方案
2012-7-30 14:33 5 2447
FPGA与CPLD
2012-7-30 10:28 11 3555
[matlab] 求助在ISE13.1开发环境中添加Embedded processor失败
2012-7-30 10:05 3 5033
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