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[modelsim] MIG3.8 ISE13.2 的时钟问题
2012-8-20 22:09 12 5550
[modelsim] virtex6的gtx模块怎么实现srio接口
2012-8-20 22:09 1 3512
fpga实现的多路模拟开关导通电阻是多大?
2012-8-20 21:53 5 2579
求助,利用JTAG下载bit文件时出错!
2012-8-20 10:22 10 4892
请教有没有大虾搞过can控制器IP核的?
2012-8-20 10:16 3 2046
双时钟状态机的设计问题
2012-8-18 21:54 2 1991
反电动势控制BLDC 精华讲解! attachment
2012-8-18 21:13 0 3339
LCD1602源程序 attachment agree
2012-8-18 20:42 5 2603
[verilog] ZEDBOARD 典型应用电路 attachment agree
2012-8-18 19:26 12 3604
复位问题
2012-8-18 12:40 8 2843
[CPLD] 基于FPGA的谐波电压源离散域建模与仿真
2012-8-18 12:36 2 2333
[CPLD] 利用FPGA 平台构建汽车驾驶辅助系统算法
2012-8-18 12:36 1 2075
[VHDL] FPGA与DSl8820型温度传感器通信的实现
2012-8-17 21:11 1 1597
FPGA工程师如何 写简历的几点建议(转) agree
2012-8-17 21:11 16 4559
基于FPGA的智能温度控制器 attachment
2012-8-17 21:08 11 2333
[CPLD] 基于FPGA+ DSP的实时图像处理系统设计与实现
2012-8-17 21:06 0 2103
学习CPLD之前应有哪些准备工作?  ...2
2012-8-17 16:04 22 4149
FPGA项目外包
2012-8-17 11:07 0 2304
FPGA I/O上电默认状态是1还是0?
2012-8-17 10:32 6 3852
SP6的MCB的地址线和数据线组内位置可以调整吗
2012-8-17 10:28 4 2461
FPGA牛人的经验谈
2012-8-16 18:27 7 2421
[CPLD] 用FPGA实现汽车视频和图形控制
2012-8-16 14:58 14 3417
FPGA外设的架构设计 attach_img
2012-8-15 19:33 4 1941
请教:如何由熔丝图文件反推CPLD各引脚的连接关系?
2012-8-15 18:47 1 2580
新手求教
2012-8-15 09:03 3 2258
求解!谢谢各位高手了!
2012-8-14 17:01 2 1950
请问ise13.1里面对virtex2系列芯片进行仿真啊
2012-8-14 16:23 3 2129
星航宇通国际贸易有限公司
2012-8-14 11:40 0 1598
地址比较器用组合逻辑还是时序逻辑?
2012-8-14 08:53 2 1872
verilog语言实现crc16的串行和并行算法
2012-8-13 22:27 19 16728
[求助]spartan-6的reset可以随意指定管脚么?
2012-8-13 22:25 5 5052
请教关于spartan6和DDR2的几个信号
2012-8-13 22:24 1 1516
[CPLD] 求助。。。谁知道xilkernel里执行一条代码的时间?
2012-8-13 17:18 0 2265
关于调用ipcore乘法器求助
2012-8-13 14:18 0 2070
[VHDL] 基于FPGA的FFT算法优化及其在磁共振谱仪中的应用  ...2
2012-8-13 11:29 21 4904
用FPGA分频问题请教
2012-8-12 21:50 3 1915
猴哥,求时序设计软件!!
2012-8-12 21:49 9 2131
现在搞通信行研发都做FPGA吗? attach_img
2012-8-12 13:37 5 2856
使用外置FIFO芯片还是FPGA内部实现??
2012-8-12 08:57 9 5644
quartus ii 文件管理问题
2012-8-11 22:33 3 2511
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