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ADC/DAC 应用设计宝典——电子工程师必备(完全免费) agree  ...2
2012-3-19 15:31 20 9088
IP 核应用 attachment
2012-3-18 22:22 8 2315
有没有往microblaze上移植操作系统的兄弟
2012-3-18 20:21 2 1996
chipscope可看的信号类型是什么?
2012-3-18 18:00 11 4043
在SDK中使用XMD consol进行下载
2012-3-18 11:14 0 4414
FPGA设计高级技巧Xilinx篇.pdf(华为) attachment
2012-3-18 07:15 11 3525
求助:fpga fir算法实现
2012-3-18 00:03 6 2680
ise 12.4 安装失败 点开ise图标出现clip host attach_img
2012-3-17 23:55 11 6252
可编程逻辑器件基础知识 attachment
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EDK经典教程。分享 attachment
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【求助】FPGA输出管脚不能设为低电平
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利用赛灵思FPGA实现跳频MSK信号检测算法 agree
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[VHDL] mch_emc IP的时序问题 attachment
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请教一个verilog的问题  ...2
2012-3-16 16:58 21 3505
ISE后仿
2012-3-16 14:58 3 1943
spartan3e SD卡控制器问题
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求教:急 NIOS不能运行
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低功耗FPGA设计的现在和将来 attachment
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数码管7段显示
2012-3-16 09:36 5 1938
你需要一个什么样的FPGA的开发板?
2012-3-16 07:04 4 2117
ISE后仿
2012-3-15 21:39 2 2177
论坛共享的UART的IP根本不是Mentor的,求Mentor的 attachment
2012-3-15 21:28 11 2367
altera 的cpld功耗偏高!!!
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如何控制FPGA的IO口
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紧急help:这个verilog文件xst check syntax报错 attachment
2012-3-15 19:19 3 3109
基于FPGA的图像预处理快速算法及仿真
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没人做过吗?????毕业设计 fpga实现led体三维显示设计
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quartus 里用verilog编程,'timescale为什么不能使用?
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求助:inout端口在test文件里面作为输入怎么用
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VHDL PROCESS 敏感信号太多怎么办?
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2012年慕尼黑(印度)电子元器件展览会
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准备从sp605开始学习xilinx的fpga attach_img
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