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ISE开发环境使用指南 se AC 明空 2012-3-29 19:24 10 2981
为什么需要多个DCM模块？ DCM 信号时钟梦境缠绕 2012-3-29 19:17 7 3807
这样算不算流水线呢？ ST Stage aikimi7 2012-3-29 18:35 6 2244
fpga如何驱动打印机 FPGA PGA 打印机 xiaoniubuniu 2012-3-29 17:11 1 1480
FPGA 读写SRAM（关于如何分配sram的问题） FPGA 读写 52228254 2012-3-29 16:01 7 3887
FPGA中怎么调用现有的模块 FPGA PGA liu_yi_xf 2012-3-29 15:53 1 1964
请教：ISE中modelsim后仿过不了，怎么直接定位问题？ modelsim se FPGA yuxiang2008 2012-3-29 08:52 10 3309
[verilog] Secure IP Delivery Flow Delivery Secure ip Oxygen.Chu 2012-3-29 08:50 18 3620
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ALTERA的 FPGA设计，如何封装成IP核？ altera FPGA设计 ip核 Windmill_CN 2012-3-28 21:20 3 3066
Verilog小数定标问题 verilog verilo 代码 aikimi7 2012-3-28 20:24 6 2625
Xilinx FPGA的Fast Startup startup FPGA FAST anqier1 2012-3-28 18:11 6 2324
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FPGA/CPLD数字电路设计经验分享数字电路设计 FPGA/CPLD ooljo 2012-3-28 15:31 12 2817
新人求助！！老师让自己做CPLD，但是我不会的实在太多了。 protel TE 杀猪王子 2012-3-28 10:19 7 1915
基于FPGA一种OFDM的实现 FPGA ofdm调制 anqier1 2012-3-28 10:02 8 2532
斯巴达3e start starter 赛灵思 sunmax 2012-3-28 09:59 18 3785
[求助]FPGA布线后仿真的问题 FPGA 布线后仿真梦境缠绕 2012-3-28 09:11 6 2682
选型选型 FPGA 数字信号处关羽不爱跑 2012-3-28 08:33 10 2348
请教兄弟们一个verilog的程序问题 verilog PLD skiry 2012-3-28 08:27 7 2396
Xilinx ISE软件当中的工程当中的automatic include include XILINX ise软件 brace1108 2012-3-27 23:25 1 5156
C++ 播放器设计 C++ liuxupu 2012-3-26 23:10 6 2685
ISE综合属性问题 se RS Chip gongjian32 2012-3-26 23:09 12 4394
[VHDL] 使用PLL的约束问题 PLL 时钟电路 shallsure 2012-3-26 23:09 5 3308
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自己摸索FPGA——ISE使用modelsim仿真的问题 FPGA modelsim 仿真 alecsoo 2012-3-26 22:47 6 2470
microblaze 差分clk Micro MICROBLAZE ic why2009a 2012-3-26 22:46 7 2672
基于FPGA平台的工业电机最大效率实现 FPGA 电机控制 anqier1 2012-3-26 22:23 2 2145
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一个verilog的问题：用户自定义原语(UDP)是不是无法综合？ udp verilog verilo lonelyking1716 2012-3-26 21:02 1 2765
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