今日: 3|主题: 14256|帖子: 104506 收藏 (180)
quartus 2 11.0安装完后出现这样的问题! attach_img
2012-2-27 13:21 1 2600
各位,有没有带千兆网接口的fpga开发板卖?
2012-2-27 13:10 8 3195
外部输入时钟ext_clock需要IBUF嘛? attach_img
2012-2-27 11:22 8 3987
[CPLD] SPI编程下载,第一次对,第二次失败。为什么吗? attachment  ...2
2012-2-27 10:34 35 5781
关于I2C总线的速度
2012-2-26 20:24 8 2228
借助赛灵思第二代目标设计平台赢取新的市场 attach_img digest
2012-2-26 10:43 5 2483
赛灵思首批加速7系列FPGA设计生产力和系统集成的设计平台 digest
2012-2-26 10:37 8 2185
赛灵思:超越摩尔定律
2012-2-26 10:36 7 2172
LX9 Microbloard第一轮问题答案 attach_img  ...2
2012-2-26 09:42 24 12209
做FPGA的前途,供讨论,求解
2012-2-25 22:38 10 3137
怎么转积分
2012-2-25 21:05 10 2177
IO_L06N_0/VREF脚作输入脚时报错。
2012-2-25 20:11 7 2403
赛灵思的功耗评估工具已经推出便携版本(IPhone Andriod) attach_img
2012-2-25 11:28 10 2346
ISE12.4要和什么版本的modelsim兼容呢? attach_img
2012-2-25 09:20 5 2716
最近心血来潮 玩了一下modelsim 来了个错误
2012-2-24 23:52 17 3795
上午论坛怎么挂掉了
2012-2-24 23:37 6 1851
关于TCO
2012-2-24 23:23 9 1948
ISE中编译仿真库问题
2012-2-24 23:22 1 2155
视频消隐
2012-2-24 21:33 12 2526
[FPGA] JTAG下载线初始化出错,大家看看什么问题? attach_img
2012-2-24 17:21 9 2982
请教,lwip中netbuf_free和netbuf_delete有何区别?
2012-2-24 14:44 0 3783
怎么对Verilog定义的memory初始赋值
2012-2-24 12:35 6 8096
求助 quartus2 仿真双向接口
2012-2-24 11:20 1 1975
2012 第一场Xilinx免费大型最新课程培训: 深圳 2012-2-24
2012-2-23 20:44 10 2448
赛灵思全面提升7系列FPGA的设计生产力和系统集成能力 digest
2012-2-23 20:39 3 2901
ZYNQ的开发过程是不是和MB和PPC一样啊?
2012-2-23 16:35 4 1996
怎么样进行DCM仿真? attachment
2012-2-23 16:02 9 2551
双向IO怎么处理
2012-2-23 10:39 6 2534
FPGA之时序问题
2012-2-23 00:07 18 4652
一般情况fpga从上电到程序运行,需要多少延时?
2012-2-22 21:02 3 2812
猴哥:modelsim6.5c 和modelsim6.5se区别 attach_img
2012-2-22 19:09 17 3602
Xilinx 有没有SDIO的参考设计?
2012-2-22 17:34 11 4001
FPGA的高端技术寻租
2012-2-22 16:10 0 1996
Spartan6 Core Generator DDR3
2012-2-22 16:05 1 2395
ISE进行设计实现时 提示错误
2012-2-22 13:58 2 2637
如图modelsim时序仿真时波形上方message行的红色提示什么? attach_img
2012-2-22 13:57 7 3988
altera中文论坛上线啦!!
2012-2-22 11:21 6 3638
[Quartus] EMAC时钟输出为什么使用DDR
2012-2-21 17:15 6 2976
痛苦的过程,好的结果!
2012-2-21 17:04 6 2278
一般1个vhd文件中,写几个process比较好
2012-2-21 16:11 1 1988
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