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[FPGA] 例说FPGA连载43:DDR控制器集成与读写测试之DDR2引脚电平设... attach_img
2016-11-3 17:53 0 908
[FPGA] 例说FPGA连载42:DDR控制器集成与读写测试之DDR2 IP核接口时序 attach_img
2016-11-3 17:14 0 997
FPGA + 2片DDR3的设计及走线问题
2016-11-3 10:37 2 1846
[FPGA] 请教Cyclone IV的命令规则
2016-11-2 16:16 1 890
[FPGA] fpga做spi从机接收模块 attach_img
2016-11-1 16:46 4 1839
[FPGA] ISE uart_baud_gen.v attach_img
2016-11-1 10:49 0 732
[FPGA] 有没有FPGA做加密的{:smile:} 新人帖
2016-11-1 10:36 3 885
[FPGA] rapidio接口定义 attach_img
2016-11-1 09:56 1 1354
[CPLD] 关于ALTERA CPLD MAX3000A EPM3064ATC44-10的功耗
2016-10-31 20:59 0 1329
[VHDL] testbench的编写 attach_img
2016-10-31 10:04 4 1229
[FPGA] 如何实现实现Verilog实现的硬件逻辑与soc联合开发 新人帖
2016-10-30 16:49 2 946
[FPGA] 求助各位大神,仿真一个200分频时钟,不知为何产生结果... attach_img
2016-10-28 13:55 4 993
[FPGA] 这个找不到相关文档 attach_img
2016-10-28 13:45 0 716
[FPGA] 例说FPGA连载41:DDR控制器集成与读写测试之DDR2 IP核接口描述 attach_img
2016-10-27 16:12 0 1338
[FPGA] 请教ALTERA的FPGA什么时候开始使用6输入LUT? 新人帖 attach_img
2016-10-26 11:10 0 997
Verilog调用vhdl代码,参数传不进去!!! attach_img
2016-10-25 22:04 3 1784
[VHDL] 不明白老板为啥不让用variable,一个进程只许一个赋值语句
2016-10-25 22:02 5 1783
[CPLD] 利用Lattice的CPLD实现电平转换
2016-10-25 14:26 7 3458
[CPLD] 求教关于CPLD IO口对电压识别的问题 新人帖 attach_img
2016-10-24 22:18 1 1149
[FPGA] altera FPGA max10 内置的adc怎么用啊 ?!!?说明书没用啊 新人帖
2016-10-24 16:23 0 1801
[FPGA] 研发设计就是人生阅历
2016-10-23 13:19 4 1642
请帮忙分析NIOS的串口DMA接收不正常原因
2016-10-20 11:14 0 964
[FPGA] FPGA某个引脚输出电压为1.66V,不是3.3V attach_img
2016-10-19 20:00 8 2442
[FPGA] 例说FPGA连载40:DDR控制器集成与读写测试之DDR2控制器IP配置 attach_img
2016-10-19 18:14 0 1168
[FPGA] 善用Vivado工程配置文件xpr快速工程创建 attach_img
2016-10-19 17:40 0 1366
[FPGA] 急求!9054进入不了BIOS 新人帖
2016-10-18 23:26 0 962
[Quartus] device family 新人帖 attach_img
2016-10-18 21:05 0 1038
[FPGA] 菜鸟第一次用FPGA,请教各位前辈几个基本的问题,急急急~ attachment
2016-10-18 16:32 2 1325
怎样检测最后一个脉冲 attach_img
2016-10-16 11:56 11 1558
modelsim新版本是多少?
2016-10-15 11:37 0 1680
[Quartus] 有人知道这是为什么 吗? attach_img
2016-10-15 11:33 1 1277
[FPGA] 例说FPGA连39:DDR控制器集成与读写测试之FPGA片内RAM设置与.. attach_img
2016-10-14 17:46 0 1166
[FPGA] FPGA有什么好的进阶教程
2016-10-14 16:46 0 927
[FPGA] vivado中net的conflict和unrouted有什么不同?
2016-10-13 15:04 0 1536
关于DM9000CEP问题
2016-10-12 17:43 11 2057
[FPGA] 例说FPGA连载38:DDR控制器集成与读写测试之FPGA片内RAM概述 attach_img
2016-10-12 17:02 0 976
[verilog] 求解释SPI代码,有几点不明白 attach_img
2016-10-12 11:11 4 4004
[FPGA] 请问这两句话是如何实现移位的。
2016-10-11 23:01 5 1693
[FPGA] 使用FPGA时钟展频技术搞定RE测试 attach_img
2016-10-11 17:16 0 1151
[FPGA] Altera FPGA Fifo使用遇问题
2016-10-11 11:34 2 1104
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