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CPLD verilog 开发属于硬件开发还是软件开发
CPLD ，verilog ，软件开发 ，硬件开发 ，控制
FPGA论坛 wangjianf5 2015-2-25 6 3194 habc987 2015-2-28 22:30
4组数据混在一起，如何分离开来 attach_img
HDL ，verilog ，VHDL ，芯片 ，verilo
FPGA论坛 paulkiyt 2018-6-12 6 1437 stickler 2018-6-18 09:04
Verilog 语句执行顺序
verilog ，verilo ，寄存器 ，端口
FPGA论坛 wdmhzh 2014-5-2 6 1817 wdmhzh 2014-5-7 10:49
编译是出现的问题？
编译 ，verilog ，verilo ，TI ，HDL
FPGA论坛 魔人布欧 2016-3-8 6 2115 魔人布欧 2016-3-29 19:24
T叔有没有Verilog方面的书啊？
verilog ，verilo
电子技术交流论坛 shell.albert 2012-7-30 6 1883 pingis58 2012-8-9 13:17
verilog模块里输入信号的问题
verilog ，信号 ，verilo ，Wire
FPGA论坛 nm2012 2013-4-30 6 2424 GoldSunMonkey 2013-5-1 16:06
Verilog HDL---复杂数字系统的构成
HDL ，verilog ，数字系统 ，控制 ，电路
FPGA论坛 mucanhin 2012-11-30 6 2773 GoldSunMonkey 2012-12-2 20:07
基于Verilog HDL的UART模块设计与仿真
模块设计 ，HDL ，仿真 ，verilog ，UART
ZLG msp430ing 2012-1-18 6 3189 lifenganhui 2012-2-1 15:59
请问一下关于distributed memory generator的ip核
Distributed ，generator ，ip核 ，memory ，verilog
FPGA论坛 wwuchang 2012-3-12 6 3713 GoldSunMonkey 2012-3-13 19:42
verilog 求余计算，综合时出错
verilog ，ST ，constant ，IVECO ，os
EDA 技术 cc810610186 2010-5-29 6 8939 jakfens 2011-9-2 08:50
verilog中从高电平到高阻跳变，算不算一次下降沿？ attach_img
verilog ，电平 ，ge ，model ，models
FPGA论坛 平常心kxy 2014-7-29 6 2431 luyaker 2014-8-1 10:14
运行频率和时钟频率的区别 attach_img
时钟频率 ，verilog ，仿真 ，时序 ，verilog程序
FPGA论坛 aikimi7 2012-3-22 6 2682 aikimi7 2012-3-23 10:02
VHDL和Verilog 黄金参考手册 attachment
HDL ，verilog ，VHDL ，verilo ，hd
电子技术交流论坛 mmuuss586 2013-6-16 6 2996 小耐耐 2020-1-21 09:26
verilog初始化问题
verilog ，RS ，ST ，ge ，Output
FPGA论坛 cyberbill 2014-7-10 6 1518 lizhezhe1988 2014-7-11 12:00
Verilog小数定标问题
verilog ，verilo ，代码
FPGA论坛 aikimi7 2012-3-26 6 2628 aikimi7 2012-3-28 20:24
怎么对Verilog定义的memory初始赋值
memory ，verilog ，verilo ，存储单元
FPGA论坛 ylanxuez 2012-2-12 6 8339 beck_ck 2012-2-24 12:35
Verilog编码规范(1)
编码 ，verilog ，信号 ，代码 ，编写
EDA 技术 梅花望青竹 2013-7-26 6 2493 1185391239 2014-4-5 13:05
Verilog串口通信问题
串口通信 ，verilog ，RS ，ST ，UART
FPGA论坛 892953881 2014-12-20 6 2304 littbi 2017-12-17 11:24
应届生提问：通信算法工程师和FPGA工程师哪个发展前景好？
FPGA ，工程师 ，通信 ，verilog ，微电子
FPGA论坛 夏洛特的网ge 2017-11-13 6 4329 原子弹001 2017-11-15 18:16
问下为什么看不到波形 attachment
LSI ，model ，modelsim ，SIM ，verilog
FPGA论坛 你好旅行者 2020-4-20 6 973 你好旅行者 2020-4-21 21:33
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