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关于verilog语言的初级问题，请指教
verilog ，Verilog语言 ，verilo ，信号 ，I/O
EDA 技术 lzlsw 2009-3-30 6 3069 一只小蜗牛 2009-9-25 13:12
推荐一些FPGA设计方面的书
FPGA设计 ，PLL ，verilog ，数字系统 ，系统设计
ZLG 蹦蹦车 2009-3-20 6 2605 usber 2009-5-9 13:02
PWM
PWM ，verilog ，verilo
EDA 技术 miantan 2007-1-19 6 2745 fuyun185 2008-4-16 10:59
Verilog的问题
verilog ，verilo
EDA 技术 houjiakai 2013-12-3 6 1854 happyming0809 2013-12-5 11:16
关于用FPGA实现PWM延迟（死区）的verilog hdl程序请指正 attach_img
FPGA实现 ，verilog ，PWM ，HDL ，ge
FPGA论坛 bowlder2008 2014-1-6 6 6825 hanqingynu 2015-4-11 22:01
请问一下关于distributed memory generator的ip核
Distributed ，generator ，ip核 ，memory ，verilog
FPGA论坛 wwuchang 2012-3-12 6 3713 GoldSunMonkey 2012-3-13 19:42
Verilog 语句执行顺序
verilog ，verilo ，寄存器 ，端口
FPGA论坛 wdmhzh 2014-5-2 6 1760 wdmhzh 2014-5-7 10:49
verilog 某处多一个if语句便运行不正常的问题 attach_img
verilog ，Pulse ，se ，ni ，AI
FPGA论坛 wangwenjia 2011-9-6 6 3771 wangwenjia 2011-9-26 13:24
运行频率和时钟频率的区别 attach_img
时钟频率 ，verilog ，仿真 ，时序 ，verilog程序
FPGA论坛 aikimi7 2012-3-22 6 2682 aikimi7 2012-3-23 10:02
新手！ 求指导。 基于FPGA图像采集，存储以及显示。
FPGA ，PGA ，图像采集 ，verilog ，verilo
FPGA论坛 可爱的蓝精灵 2015-11-23 6 1383 3008202060 2015-12-3 23:48
【活动贴】Verilog HDL 综合实用教程 attachment
HDL ，verilog ，verilo ，hd ，AC
EDA 技术 feihong777 2013-4-12 6 2150 yangfchn 2013-10-23 23:46
Verilog算法及建模整理文档 attachment
建模 ，verilog ，C语言 ，HDL ，hd
FPGA论坛 tee. 2012-9-5 6 2219 okyouwin 2012-9-7 11:27
新手求助verilog
verilog ，时钟 ，数据收发 ，hz ，系统时钟
FPGA论坛 hbjdt 2016-5-30 6 1216 linfulin 2016-6-28 09:19
问下为什么看不到波形 attachment
LSI ，model ，modelsim ，SIM ，verilog
FPGA论坛 你好旅行者 2020-4-20 6 973 你好旅行者 2020-4-21 21:33
急聘 ic设计工程师、项目经理、总经理助理--新公司（上海）
工程师 ，IC设计 ，电路 ，verilog ，verilo
EDA 技术 swfywx 2009-3-23 6 2714 shuai1 2009-8-6 11:13
T叔有没有Verilog方面的书啊？
verilog ，verilo
电子技术交流论坛 shell.albert 2012-7-30 6 1883 pingis58 2012-8-9 13:17
Quaruts II 编译向量的数组报错
向量 ，编译 ，TE ，verilo ，verilog
FPGA论坛 kun5979 2012-10-19 6 7697 ifpga 2013-2-22 16:23
求助，verilog中多个模块的引用
verilog ，LED ，se ，SIGNAL ，ISP
FPGA论坛 flyriz 2012-10-24 6 3261 Backkom80 2012-10-26 08:45
verilog 今日心得
verilog ，电路 ，硬件电路 ，硬件 ，计数器
FPGA论坛 TataJen 2014-2-16 6 1569 丁弋宇 2014-2-19 16:06
编译是出现的问题？
编译 ，verilog ，verilo ，TI ，HDL
FPGA论坛 魔人布欧 2016-3-8 6 2115 魔人布欧 2016-3-29 19:24
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