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关于Verlog TASK的问题
verlog ，verilog ，编写 ，阻塞 ，阻塞赋值
FPGA论坛 jakfens 2011-8-11 6 2204 jakfens 2011-8-12 08:52
verilog的一个问题
verilog ，ge ，edge ，ST ，os
FPGA论坛 dobypig 2012-5-15 6 1424 可木 2012-5-18 00:02
Verilog串口通信问题
串口通信 ，verilog ，RS ，ST ，UART
FPGA论坛 892953881 2014-12-20 6 1914 littbi 2017-12-17 11:24
问下为什么看不到波形 attachment
LSI ，model ，modelsim ，SIM ，verilog
FPGA论坛 你好旅行者 2020-4-20 6 635 你好旅行者 2020-4-21 21:33
verilog hdl硬件描述语言(中文教程) attachment
HDL ，verilog ，硬件描述语言 ，VerilogHDL
ZLG 想实习去 2010-1-17 6 2276 aqua2013 2016-6-10 22:01
运行频率和时钟频率的区别 attach_img
时钟频率 ，verilog ，仿真 ，时序 ，verilog程序
FPGA论坛 aikimi7 2012-3-22 6 1984 aikimi7 2012-3-23 10:02
Quaruts II 编译向量的数组报错
向量 ，编译 ，TE ，verilo ，verilog
FPGA论坛 kun5979 2012-10-19 6 6957 ifpga 2013-2-22 16:23
关于用FPGA实现PWM延迟（死区）的verilog hdl程序请指正 attach_img
FPGA实现 ，verilog ，PWM ，HDL ，ge
FPGA论坛 bowlder2008 2014-1-6 6 6162 hanqingynu 2015-4-11 22:01
VHDL和Verilog 黄金参考手册 attachment
HDL ，verilog ，VHDL ，verilo ，hd
电子技术交流论坛 mmuuss586 2013-6-16 6 2292 小耐耐 2020-1-21 09:26
Verilog编码规范(1)
编码 ，verilog ，信号 ，代码 ，编写
EDA 技术 梅花望青竹 2013-7-26 6 1809 1185391239 2014-4-5 13:05
verilog中从高电平到高阻跳变，算不算一次下降沿？ attach_img
verilog ，电平 ，ge ，model ，models
FPGA论坛 平常心kxy 2014-7-29 6 2118 luyaker 2014-8-1 10:14
新手准备开始学习FPGA，开发板的选择，dalao们进来给建议
FPGA ，开发板 ，硬件 ，verilog ，嵌入式
FPGA论坛 cross_stone 2017-3-17 6 1264 xiongbb 2017-5-8 07:37
verilog模块里输入信号的问题
verilog ，信号 ，verilo ，Wire
FPGA论坛 nm2012 2013-4-30 6 1782 GoldSunMonkey 2013-5-1 16:06
verilog 今日心得
verilog ，电路 ，硬件电路 ，硬件 ，计数器
FPGA论坛 TataJen 2014-2-16 6 1292 丁弋宇 2014-2-19 16:06
VHDL和Verilog换行符
HDL ，verilog ，VHDL ，verilo ，hd
EDA 技术 0林心诚0 2014-5-20 6 22885 520123 2014-5-22 18:15
新手！ 求指导。 基于FPGA图像采集，存储以及显示。
FPGA ，PGA ，图像采集 ，verilog ，verilo
FPGA论坛 可爱的蓝精灵 2015-11-23 6 1040 3008202060 2015-12-3 23:48
推荐一些FPGA设计方面的书
FPGA设计 ，PLL ，verilog ，数字系统 ，系统设计
ZLG 蹦蹦车 2009-3-20 6 1687 usber 2009-5-9 13:02
ＣＰＬＤ　的正交信号解码
信号 ，解码 ，DM ，verilog ，传感
EDA 技术 jiaxinhui 2007-11-14 6 1712 jzt369 2007-11-19 19:55
T叔有没有Verilog方面的书啊？
verilog ，verilo
电子技术交流论坛 shell.albert 2012-7-30 6 1329 pingis58 2012-8-9 13:17
求助，verilog中多个模块的引用
verilog ，LED ，se ，SIGNAL ，ISP
FPGA论坛 flyriz 2012-10-24 6 2516 Backkom80 2012-10-26 08:45
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