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verilog中从高电平到高阻跳变，算不算一次下降沿？ attach_img
verilog ，电平 ，ge ，model ，models
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怎么对Verilog定义的memory初始赋值
memory ，verilog ，verilo ，存储单元
FPGA论坛 ylanxuez 2012-2-12 6 8332 beck_ck 2012-2-24 12:35
基于Verilog HDL的UART模块设计与仿真
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ZLG msp430ing 2012-1-18 6 3167 lifenganhui 2012-2-1 15:59
CPLD verilog 开发属于硬件开发还是软件开发
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FPGA论坛 wangjianf5 2015-2-25 6 3093 habc987 2015-2-28 22:30
Verilog HDL那些事儿
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EDA 技术 hobbye501 2021-6-25 6 13958 gxl006 2021-9-27 15:51
verilog的一些概念
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ZLG 杜_U_ME 2011-5-29 6 3226 diny 2011-6-25 23:30
新手求助verilog
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FPGA论坛 hbjdt 2016-5-30 6 1216 linfulin 2016-6-28 09:19
夏宇闻老师书第9章例9.4的问题 attach_img
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FPGA论坛 比神乐 2023-3-21 6 1510 比神乐 2023-3-22 10:14
应届生提问：通信算法工程师和FPGA工程师哪个发展前景好？
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FPGA论坛 夏洛特的网ge 2017-11-13 6 4329 原子弹001 2017-11-15 18:16
Verilog 代码，问题出在哪，小白求助，在线等 attach_img
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FPGA论坛 zhaironghui 2015-10-22 6 1419 玄德 2015-11-11 21:36
初学者如何学习FPGA！(转)
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FPGA论坛 AutoESL 2011-4-22 6 3567 梅花望青竹 2012-11-9 12:40
请教提高FPGA的速度
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EDA 技术 忘情天书 2008-1-3 6 3036 harlemjia 2008-1-19 18:54
新手准备开始学习FPGA，开发板的选择，dalao们进来给建议
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FPGA论坛 paulkiyt 2018-6-12 6 1437 stickler 2018-6-18 09:04
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FPGA论坛 0中国芯0 2011-4-16 6 2697 AutoESL 2011-4-19 21:28
急聘 ic设计工程师、项目经理、总经理助理--新公司（上海）
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ＣＰＬＤ　的正交信号解码
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EDA 技术 jiaxinhui 2007-11-14 6 2450 jzt369 2007-11-19 19:55
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FPGA论坛 892953881 2014-12-20 6 2304 littbi 2017-12-17 11:24
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