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东南大学Verilog讲义 attachment FPGA论坛 wangjun88 2010-8-20 0 1576 wangjun88 2010-8-20 09:40
用verilog写的HDB3编码程序 FPGA论坛 chenqinte 2010-8-17 0 2272 chenqinte 2010-8-17 10:01
综合前后仿真不一致 ZLG bit6019 2010-8-13 2 1336 金鱼木鱼 2010-8-20 18:56
Cadence 的Verilog-XL可以做门级功能仿真吗? EDA 技术 irun2 2010-8-4 1 3400 zhang_2000 2010-8-17 20:49
代码编写时产生的锁存器行为,为什么被称为设计错误 FPGA论坛 chenqinte 2010-8-2 4 3584 chenqinte 2010-8-5 21:26
CPLD写操作问题
CPLDnigeverilogverilo
FPGA论坛 colddown 2010-7-27 3 2018 欧阳青云 2010-8-1 14:34
FPGA培训初级研修班(至芯FPGA创新中心) 供需广告 fpgaw 2010-7-27 1 1078 qiao2008400 2010-7-27 18:06
选择VHDL还是verilog HDL? FPGA论坛 akii 2010-7-19 16 3669 xueqi_147 2010-10-20 12:35
verilog HDL寄存器元素赋值问题 EDA 技术 欧阳青云 2010-7-18 10 6399 luckyaya 2010-8-9 22:20
一个Verilog测序 看不懂 是个乘法器 请教下 谢谢 新手园地 yanzhiyi1012 2010-7-14 1 1965 yanzhiyi1012 2010-7-14 20:02
求verilog的矩阵运算(乘法、求逆)程序 FPGA论坛 钟冰1986 2010-7-10 1 6643 汉江之源 2010-7-12 15:54
散50分,只为请教一个问题,,
HDLverilogVHDLverilohd
FPGA论坛 ZHOUNACHU 2010-5-30 49 7046 tobevan 2011-11-15 12:35
verilog 求余计算,综合时出错
verilogSTconstantIVECOos
EDA 技术 cc810610186 2010-5-29 6 7584 jakfens 2011-9-2 08:50
问一个Verilog 程序的问题,实现数据总线 FPGA论坛 zhousun 2010-5-26 3 2947 zhousun 2010-5-29 20:52
版主请进!
HDLverilohdverilogLibero
ZLG 米其林r 2010-5-14 2 1182 金鱼木鱼 2011-3-31 15:54
quartus中的锁相环和Verilog的链接问题 attach_img FPGA论坛 kpengs 2010-5-12 2 4673 kpengs 2010-5-13 19:20
【求助】:基于verilog的数字密码锁 FPGA论坛 anshasha 2010-5-4 1 3010 fyshuljj 2010-5-5 23:09
非常紧急! ZLG 年轻不在 2010-5-14 1 1013 六楼的窗户 2010-5-14 12:12
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verilog的循环语句本质是怎么实现综合的? FPGA论坛 z_no1 2010-7-27 2 3600 欧阳青云 2010-7-28 14:07