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Atlys开发板FPGA Design Flow LAB3的KPSM3程序
2012-10-24 23:33 2 2231
Atlys开发板FPGA Design Flow LAB4的KPSM3程序
2012-10-24 23:33 1 2289
Atlys开发板FPGA Design Flow LAB5的KPSM3程序
2012-10-24 23:33 1 1837
赛灵思 FY13 Q2: 28nm产品销售超2000万美元(ZT)
2012-10-24 16:52 2 1570
FPGA与CPLD有啥区别?哪个更适合用在电机控制中?
2012-10-24 16:39 9 3971
在FPGA开发中尽量避免全局复位的使用?(1)
2012-10-24 16:23 6 2021
SPARTAN6的DDR2中soft Calibration??
2012-10-24 13:18 5 2184
一个简单功能,如何VHDL实现?  ...2
2012-10-24 12:54 22 4444
SPARTAN6中的软校准-第二问 ?
2012-10-24 12:51 5 1835
[VHDL] 基于XilinxFPGA的高速Viterbi回溯译码器 attachment
2012-10-24 12:21 1 2155
ISE与EDK联合开发流程
2012-10-24 12:20 16 5097
[CPLD] 基于XilinxFPGAIP核的FFT算法 attachment
2012-10-24 12:20 2 1841
[matlab] 用ISE原理图编辑问题 attach_img
2012-10-24 12:04 7 3223
ep3c的PLL1_CLKOUTn脚可以做普通的io吗?
2012-10-24 08:40 6 3012
[CPLD] 基于Xilinx_PicoBlaze软核的数字频率计的设计与实现 attachment
2012-10-23 23:57 1 1651
今天解决了一个很基础的问题
2012-10-23 23:52 3 1922
[CPLD] XilinxFPGA上电时序分析与设计 attachment
2012-10-23 23:29 0 2091
[CPLD] 使用Xilinx的Spartan_6FPGA作DDR芯片测试 attachment
2012-10-23 23:12 0 1671
在FPGA开发中尽量避免全局复位的使用?(3) agree
2012-10-23 22:03 3 2036
[CPLD] XilinxSRAM型FPGA抗辐射设计技术研究 attachment
2012-10-23 22:02 2 1871
在FPGA开发中尽量避免全局复位的使用?(5)
2012-10-23 22:02 3 1865
在windows 7安装xilinx usb cable成功
2012-10-23 22:02 3 3933
时序的几个概念 attachment agree
2012-10-23 22:02 16 3209
RADX、Xilinx和ADI联合演示先进的可编程EdgeQAM技术方案
2012-10-23 22:01 3 2066
在FPGA开发中尽量避免全局复位的使用?(4)
2012-10-23 20:20 3 1536
在FPGA开发中尽量避免全局复位的使用?(2)
2012-10-23 19:00 2 1922
如何通过FPGA实现通过光模块通讯?  ...2
2012-10-23 12:38 27 8355
FPGA Design Flow 学习笔记(9)
2012-10-23 08:47 9 3261
[CPLD] 基于XilinxFPGA的电力谐波检测 attachment
2012-10-23 08:41 1 1615
[VHDL] 基于以太网的数据采集在XilinxFPGA上的实现 attachment
2012-10-23 08:41 1 1626
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