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今日: 0|主题: 14355|帖子: 104807

[VHDL] VHDL generate语句 新人帖
2016-10-10 22:28 0 1189
例说FPGA37:DDR控制器集成读写测试之FPGA片内存储器概述 attach_img
2016-10-10 16:51 0 966
自己做了个FPGA板子 调试的时候发现了一些问题 新人帖
2016-10-10 12:56 2 1036
[FPGA] virtex5 DDR2调试求教 attachment
2016-10-9 14:11 4 978
[FPGA] 例说FPGA连载36:DDR控制器集成与读写测试之功能概述 attach_img
2016-10-8 16:50 0 756
[FPGA] 多块FPGA 信号采集板时钟同步 新人帖 attach_img
2016-10-8 15:57 2 2062
[FPGA] 求助~~~~~~~~~板子时钟调试出现问题
2016-10-8 13:58 0 769
[FPGA] SPartan 6 XC6SLX45 能不能做Display port V1.1?
2016-10-8 11:21 0 1168
[FPGA] 自己用纯verilog 写的俄罗斯方块,有很多问题,求大神指导
2016-10-7 19:04 4 3089
[Quartus] 帮助不能正常使用 新人帖
2016-10-7 16:28 0 1268
[FPGA] 例说FPGA连载35:PLL例化配置与LED之闲置引脚设置 attach_img
2016-10-6 16:43 0 1073
CPLD(EPM240)+SDRAM 控制OV5640的500w像素拍摄方案,任何单片机可用
2016-10-3 14:10 17 5868
[FPGA] FPGA输出32.768 时钟,硬件PCB是否需要做包地处理。
2016-9-30 08:26 0 915
[FPGA] FPGA管脚电压部分不对 新人帖
2016-9-28 22:52 2 1467
[FPGA] spartan6 spi配置模式下的烧写失败 新人帖
2016-9-27 21:18 0 1537
[FPGA] Lattice FPGA项目开发外发 新人帖
2016-9-27 00:37 5 2074
[FPGA] [锆石科技]收到活动的板子了,晒晒! 新人帖 attach_img
2016-9-25 08:40 14 2162
[FPGA] LED-PWM调制 attach_img
2016-9-24 08:55 0 890
[FPGA] 例说FPGA连载34:PLL例化配置与LED之使用TCL Scripts进行引脚分配 attach_img
2016-9-23 09:11 0 834
[FPGA] NIOS II .S源文件语法请教
2016-9-22 21:08 0 1006
[FPGA] 求助:自己设计的FPGA板子无法进行JTAG下载 新人帖 attach_img
2016-9-22 16:09 17 4623
[FPGA] 用microblaze的axi结构时,网表正常生成,但是产生bit文件出错 新人帖
2016-9-21 22:37 3 1443
[FPGA] 关于差分输入串行数据处理后输出的问题 新人帖
2016-9-19 20:55 0 770
[FPGA] 关于FPGA在视频处理方面应用 新人帖
2016-9-19 20:15 0 715
[FPGA] spartan-6 的VCCAUX要怎么接
2016-9-19 19:41 1 1203
[FPGA] 晒晒板子 attach_img
2016-9-19 18:39 11 1657
[FPGA] 例说FPGA连载33:PLL例化配置与LED之使用Tcl Console进行引脚分配 attach_img
2016-9-17 17:36 0 898
[FPGA] spartan6千兆以太网GMAC RGMII直连
2016-9-17 09:31 5 3013
锆石科技A4开发板到了,上贴庆祝一下
2016-9-16 19:14 0 1633
[FPGA] 自己做了块双端口的千兆以太网FMC-LPC夹层卡 测试了一下ZedBo attach_img agree  ...2
2016-9-14 22:26 26 9007
[FPGA] 例说FPGA连载32:PLL例化配置与LED之使用Pin Planner进行引脚分配 attach_img
2016-9-14 16:36 0 888
[FPGA] 面试时提到一个关于大计数器的问题 新人帖
2016-9-13 17:19 13 3911
VHDL如何表达一个位数可变的常数?
2016-9-13 11:42 1 1316
请教下xilinx spartan-6 OSERDES2级联的用法,谢谢。
2016-9-12 18:16 2 4400
[FPGA] 例说FPGA连载31:PLL例化配置与LED之PLL的IP核配置 attach_img
2016-9-12 17:03 0 903
[FPGA] 使用altera的fpga时无**确读取IO的状态
2016-9-12 13:06 4 1201
牛人的FPGA设计经验分享 digest agree  ...23
2016-9-11 22:43 55 17838
vivado中的vhdl代码 新人帖 attach_img
2016-9-11 17:34 2 1701
请教猴哥,关于之前OC3使用FPGA实现的问题
2016-9-10 09:56 1 693
[FPGA] Synplify pro综合结果作为ISE/Vivado的输入?
2016-9-10 01:52 0 2246
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