本版专家: gaochy1126
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使用ALLEGRO SI仿真时的警告怎么消除
2021-10-27 16:13 0 6214
[FPGA] proteus的问题 attach_img
2021-10-25 09:50 0 5080
[FPGA] Zynq上IIC驱动 attach_img
2021-10-23 20:56 0 5707
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2021-10-23 20:49 0 6012
[FPGA] 使用Vivado IDE attachment
2021-10-23 20:49 0 5860
[FPGA] max_fanout命令的正确打开方式 attach_img
2021-10-23 20:43 0 6143
[FPGA] 如何在批模式下运行 Vivado 仿真器?
2021-10-23 20:42 0 5850
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2021-10-23 20:05 0 5770
[FPGA] IO延时约束 转
2021-10-23 20:03 0 5863
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[ISE] vivado广泛使用,ISE已过时? 转
2021-9-28 15:20 0 10040
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2021-8-30 10:06 0 10841
[protel] PCB中敷铜时GND引脚与过孔的设置
2021-8-24 20:48 0 13663
[protel] PCB布局技巧
2021-8-24 20:46 0 13632
[protel] PCB——变绿解决方案
2021-8-24 20:43 0 13567
[protel] PCB拼板
2021-8-24 20:42 0 13431
[protel] PCB布局布线中地的设计
2021-8-24 20:16 0 11872
[protel] Altium Designer 如何批量修改过孔盖油
2021-8-24 20:00 0 13737
[protel] Altium Designer线宽、过孔参数与规则不符
2021-8-24 19:59 0 13840
[protel] 设置过孔盖油和过孔开窗 转
2021-8-24 19:59 0 8214
[protel] PCB走线时加过孔
2021-8-24 19:57 0 8397
[FPGA] 如何制作过孔 attach_img
2021-8-24 19:55 0 8278
[protel] Altium Designer PCB文件过大的解决办法 attach_img
2021-8-17 18:03 0 8716
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2021-8-16 18:34 0 10668
[FPGA] FPGA技术的主要发展方向
2021-7-31 20:55 0 8074
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