EDA 技术

今日: 0|主题: 7825|帖子: 43894

1 ... 3 4 5 6 789 10 11 12 ... 261 / 261 页下一页

新窗全部主题最新精华有附件最多回复最多查看零回复更多 \| 显示置顶


[Verilog HDL] Verilog中的initial块 TI initial ni gaochy1126 2023-1-31 21:51 0 2834
[Verilog HDL] verilog for循环的使用 FOR FOR循环 verilo gaochy1126 2023-1-31 21:50 0 2916
[Verilog HDL] verilog写的LCD1602 显示 CD LCD LCD1602 gaochy1126 2023-1-31 21:48 0 2770
[Verilog HDL] SPI总线的verilog实现 SPI总线 pi gaochy1126 2023-1-31 21:46 0 2930
[Verilog HDL] IIC的Verilog实现 ic iic verilo gaochy1126 2023-1-31 21:46 0 1704
[protel] PCB规则检查的报错 PCB pc gaochy1126 2023-1-31 21:43 0 1842
[protel] PCB板铺铜规则 PCB pc pcb板 gaochy1126 2023-1-31 21:37 0 1741
[protel] 将AD绘制的PCB/原理图文件导入到立创EDA AD EDA PCB gaochy1126 2023-1-31 21:30 0 5459
[Verilog HDL] Verilog入门教材推荐 verilo verilog gaochy1126 2023-1-31 21:12 0 1883
[Verilog HDL] Verilog HDL和VHDL的区别 HDL VHDL hd gaochy1126 2023-1-31 21:03 0 2219
[cadence] OrCAD Capture使用小技巧 AD CAD CAPTURE 王小琪 2023-1-10 15:27 0 6223
[Allegro] 使用Allegro的一些小技巧 ALLEGRO 王小琪 2023-1-10 15:09 0 2340
[ISE] Vivado常见问题集锦 Wire 信号数据类型 gaochy1126 2022-12-29 22:04 0 2302
[Verilog HDL] VERILOG分配语句 verilo verilog gaochy1126 2022-12-29 22:01 0 1675
[Verilog HDL] 2-4线译码器译码译码器 gaochy1126 2022-12-29 21:59 0 1773
[Verilog HDL] SR触发器触发触发器 gaochy1126 2022-12-29 21:56 0 1683
[FPGA] Altium Designer 加*方法 Altium Design Designe gaochy1126 2022-12-29 20:52* 0 1471
[cadence] Cadence LVS检查配置文件错误 AD CAD cadence gaochy1126 2022-12-29 20:26 0 2157
[protel] 关于AD9各种布线总结 AD gaochy1126 2022-9-30 16:35 0 2277
[PADS] 原理图左下角有很多封装名称堆积 AD PA littleming1028 2022-9-14 00:49 0 2390
[ISE] ISE14.7兼容性问题解决方案 se gaochy1126 2022-8-31 22:11 0 3025
[ISE] Vivado和ISE设计流程比较 AD se vi gaochy1126 2022-8-31 22:07 0 2532
[FPGA] Xilinx的Vivado与ISE区别 AD se vi gaochy1126 2022-8-31 22:07 0 2833
[protel] PADS打开PCB文件时出现提示：发生严重的运行时错误 AD PA PCB文件 gaochy1126 2022-8-31 22:04 0 3682
[protel] PADS转AD的格式以及错误处理 AD PA gaochy1126 2022-8-31 22:03 0 2729
[protel] 如何用PADS打开AD的PCB文件 AD PA PCB文件 gaochy1126 2022-8-31 22:02 0 3021
[protel] PADS工程文件导入AD AD PA gaochy1126 2022-8-31 22:02 0 2743
[protel] 将Eagle电路图格式转换成Altium Designer格式 TI ig gaochy1126 2022-8-31 22:01 0 3034
[protel] eagle打开的brd和sch转换为AD打开的原理图和PCB AD pc gaochy1126 2022-8-31 22:00 0 2491
[Verilog HDL] Verilog 中 task的使用方法 verilo gaochy1126 2022-8-30 21:46 0 2628

1 ... 3 4 5 6 789 10 11 12 ... 261 / 261 页下一页

今日: 0|主题: 7825|帖子: 43894

快速发帖

浏览过的版块