【可编程Asic(FPGA、CPLD)技术交流,HDL coding style讨论,EDA软件工具使用】
本版专家: gaochy1126
收藏本版 |订阅

今日: 0|主题: 7835|帖子: 43984

 
[Verilog HDL] 分频器 attach_img New
2026-8-31 22:11 0 44
[Verilog HDL] Verilog实例数组 attach_img New
2026-8-31 22:09 0 42
[FPGA] 关于verilog中的signed类型 attach_img New
2026-8-31 22:07 0 45
[FPGA] 仿真分析 New
2026-8-31 21:57 0 44
[FPGA] FPGA LE与门 New
2026-8-31 21:54 0 48
[Quartus] Quartus II中上拉电阻的设置方法 attachment
2026-6-29 21:20 0 60
[Verilog HDL] 数字逻辑设计 attachment
2026-6-29 21:08 0 51
Verilog时序 attachment
2026-6-29 21:07 0 50
[Verilog HDL] VerilogHDL attachment
2026-6-29 21:07 0 45
[Quartus] Modelsim仿真技巧 attachment
2026-6-29 21:06 0 51
[FPGA] Verilog定义时钟
2026-5-30 15:31 0 67
[Verilog HDL] Verilog设计分频器
2026-5-30 15:24 0 58
[FPGA] 时序约束
2026-5-30 15:16 0 55
[FPGA] FPGA学习的一些误区
2026-5-30 15:13 0 52
[FPGA] C语言书写规范 attachment
2026-5-30 15:11 0 54
[protel] PCB+LAYOUT手册 attachment
2026-5-30 15:09 0 50
[cadence] allegro使用汇总
2026-3-31 20:03 0 60
[FPGA] 为什么PCB上的单端阻抗控制50欧姆
2026-3-31 20:02 0 66
[FPGA] 关于ESD的设计方法
2026-3-31 20:01 0 70
[FPGA] Verilog实例数组
2026-3-31 19:58 0 54
[FPGA] FPGA中亚稳态
2026-3-31 19:52 0 73
RK3568 PCB LAYOUT 设计工艺建议 — 深鑫胜 新人帖
2026-3-20 23:53 0 49
[cadence] KiCad 9.0.8 Release
2026-3-18 11:36 0 70
[PADS] KiCad Version 10.0.0 Release Candidate 2 Available
2026-3-10 15:28 0 69
[Allegro] 电子专业大学生应该什么时候学PCB最好?
2026-2-26 13:52 0 160
KiCad Version 10.0.0 Release Candidate 1 Available
2026-2-24 18:06 0 169
寻上海KICAD或嘉立创PCB布线免授,有偿
2026-2-24 15:41 0 160
[protel] 请教有关Altium Designer的Power Analyzer by Keysight问题 新人帖
2026-2-4 21:19 0 227
[FPGA] 关于generate用法
2026-1-31 22:17 0 231
[Verilog HDL] verilog中的signed类型
2026-1-31 22:16 0 236
下一页 »

快速发帖

还可输入 80 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

在线客服 返回版块 返回顶部