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Libero9.1烧写反熔丝的FPGA时出错。
2012-11-21 11:46 5 1843
ADI FPGA夹层卡 简化高速数据转换器与FPGA的连接
2012-11-21 08:30 2 1557
快速实现基于FPGA的脉动FIR滤波器
2012-11-21 08:29 4 1555
CRC(Cyclic Redundancy Check)算法与实现
2012-11-21 08:26 3 2529
Xilinx公布20nm发展战略 继续保持领先一代
2012-11-21 08:26 2 1159
[verilog] 使用PL做流水灯 (转) agree
2012-11-20 17:52 3 2627
在ise 原理图里添加常数输入时,如何更改输出位宽 attach_img
2012-11-20 17:44 6 3414
专用的时钟引脚与普通的引脚有什么差别
2012-11-20 17:41 9 5157
无线电频谱和波段划分
2012-11-20 17:29 1 1866
有谁能说ARM有哪些过人之处?
2012-11-20 17:28 9 2073
Verilog非阻塞赋值的仿真/综合问题 -下
2012-11-20 17:28 5 2840
IBIS 理解说明 agree
2012-11-20 17:27 5 2713
[CPLD] 基于FPGA的软件无线电平台设计 attachment
2012-11-20 17:24 1 1460
[Quartus] 用Modelsim仿真PLL_ADV和PLL_BASE时候报错
2012-11-20 17:23 2 5086
[verilog] 基于_Xilinx_FPGA_的无线通信 attachment
2012-11-20 17:23 1 1193
SPARTAN6 mcb odt 问题 第二问 ?
2012-11-20 09:47 0 1572
XC3S200A下载一次之后JTAG搜寻不到芯片 attach_img  ...2
2012-11-20 08:09 24 4879
中国通信简史 (下) ---芯世界博客 agree
2012-11-20 00:25 4 1787
说下FPGA内部类似逻辑分析仪的chipscope信号检测技巧
2012-11-20 00:25 11 2989
[verilog] Zynq交叉编译环境链的建立与C程序编写
2012-11-20 00:22 1 2236
[verilog] ZedBoard的第一个工程Helloworld (转) agree
2012-11-20 00:21 4 2324
[verilog] zedboard的ucf文件 attachment
2012-11-19 23:58 1 1791
[modelsim] Zedboard使用评测+HDMI显示与SD读取
2012-11-19 23:32 0 2526
关于FPGA读写外部SDRAM的时钟频率(一定要是143M或者166M吗)
2012-11-19 16:47 6 2175
fpga时钟输入问题
2012-11-19 09:30 4 2482
GSM教你理解上下拉电阻(完成) digest agree  ...234
2012-11-18 22:28 61 9590
基于FPGA的RFID无线通信系统的实现
2012-11-18 19:45 13 2014
TD-SCDMA简介
2012-11-18 18:08 2 1885
[VHDL] SD卡发送CMD55和ACMD41命令
2012-11-18 17:31 1 3016
显示控制技术的技术瓶颈
2012-11-18 17:28 8 2170
汽车级 Zynq-7000 All Programmable SoC(ZT)
2012-11-18 17:27 4 1611
关于quartus和modelsim时序仿真的问题,请教!
2012-11-18 17:25 1 1542
What is ZigBee?
2012-11-18 17:25 10 2173
新手请教各位高手一个PLL的问题,不胜感激!
2012-11-18 17:24 5 1832
绝对经典的I./O双向口问题,求解答
2012-11-18 17:24 7 2014
急,关于CPLD选型的问题
2012-11-18 17:06 7 4110
quartus VHDL语言仿真问题 attach_img
2012-11-18 17:06 10 2003
中国通信简史 (上) ---芯世界博客
2012-11-18 17:01 2 1777
EPM7256AETC-10发烫,求解!
2012-11-18 16:59 8 2291
nios可以加密代码么?
2012-11-18 16:59 5 2401
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