今日: 1|主题: 14200|帖子: 104294 收藏 (179)
[CPLD] Spartan-3e下面的串行转并行的器件叫什么呢
2011-11-5 13:46 2 2169
找人做FPGA代码的升级- 好报酬
2011-11-5 10:59 0 1858
基于赛灵思FPGA的单片高性能硬件平台解决方案
2011-11-4 22:58 3 2006
FPGA/CPLD双雄又有新产品交手了!好看!
2011-11-4 21:54 2 1794
有比ALTERA 的1270 逻辑单元更多的CPLD吗?
2011-11-4 21:51 1 1763
ISE11.3调用synplify pro综合时出错:
2011-11-4 16:42 8 2406
micriblaze 内部ram mutiboot问题
2011-11-4 16:37 9 2258
寻求价格便宜的FPGA
2011-11-4 13:12 7 3002
投票 论坛周年庆活动二—“论坛之巅,谁是最受欢迎的贴主” agree  ...23
2011-11-4 10:05 51 5772
听说有VHDL和Verilog转换工具,求一个~
2011-11-4 07:18 18 3346
[设计心得]UG380
2011-11-4 07:15 13 2826
MAP出错
2011-11-4 07:08 11 6979
找人做fpga 学习版
2011-11-3 21:31 3 1961
分频器疑惑
2011-11-3 21:04 7 2096
altera 最强的cpld是什么信号啊?
2011-11-3 20:21 8 1756
[周年献礼]Xilinx初使用 attach_img  ...2
2011-11-3 18:14 20 3498
呃 有关PCB与FPGA  ...2
2011-11-3 13:31 38 3798
FPGA的分坛子
2011-11-3 12:20 7 2233
一个CPLD引脚可以带几个门?
2011-11-3 12:14 0 1385
Xilinx Zynq-7000 news from ARM TechCon
2011-11-3 09:09 13 2586
世界上容量最大的FPGA V7-2000T attach_img  ...23
2011-11-3 07:30 46 7428
为啥是2.5D而不是3D?立体堆叠FPGA是否可行?
2011-11-3 07:26 3 2430
[VHDL] v5板子上的LCD怎么用
2011-11-3 07:24 10 2500
Xilinx 上海招聘: Senior SAE  ...2
2011-11-2 22:48 35 4110
关于dsp builder 9.0**问题 attach_img
2011-11-2 20:04 1 2838
[matlab] 猴哥,给我们写一个EDK的slave和master**吧  ...2
2011-11-2 19:02 27 3795
xinlinx的pcie IP Core的应用 求教! attachment
2011-11-2 19:00 7 2756
大家谈谈和FPGA的第一次亲密接触吧  ...2
2011-11-2 18:59 34 4155
NIOS IO口边沿中断的问题
2011-11-2 16:33 3 2251
如何实现EDK中调用ISE里面的IP核  ...2
2011-11-2 13:27 20 4843
[VHDL] 赛灵思V5实现PCIE IP核的控制问题,求助!谢谢  ...2
2011-11-2 13:26 37 5870
【转】有感于摩根大通用XILINX FPGA做金融超级计算机  ...23
2011-11-2 07:35 51 6431
Verilog 视频讲解 agree  ...23
2011-11-2 07:34 45 6469
同学们,ise13.3已经可以下载了
2011-11-2 07:30 12 2553
Xilinx的软件和设计工具简介
2011-11-1 20:29 15 2353
[matlab] EDK里的sdk调用
2011-11-1 20:12 2 1691
抢楼活动非官方,我自己计算的中奖名单(不具官方效力)
2011-11-1 11:16 13 7824
[matlab] 求助啊,ise编译错误,6.1中有,7.1和10.1没问题 attachment  ...2
2011-11-1 10:39 22 9925
VHDL中的SRL运算符可以被综合吗?使用时要包含哪个库
2011-11-1 09:22 2 3836
FPGA周年献礼活动进行的怎么样了?  ...23
2011-11-1 08:24 40 4788
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