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[matlab] 求问：EDK中综合以太网控制器时遇到的问题 NET vergil_gxw 2011-11-25 21:53 11 3294
FPGA挂载DDR的思考 DDR FPGA PGA wxfxwk1986 2011-11-25 20:39 4 3023
有关modelsim6.5b仿真报错的问题仿真 modelsim TI 汉江之源 2011-11-25 14:00 5 5014
xilinx的FIFO IP核求教？ FIFO ip核 XILINX ottomia 2011-11-25 10:35 2 3482
LTE基带目标设计平台方案详解 LTE XILINX tikelu 2011-11-24 22:18 5 2235
新手问问谁能给简单介绍一下EDA/PLD技术 EDA PLD xlhtracy 2011-11-24 16:32 1 2065
FPGA基础知识基础知识 FPGA 芯片万盛半导体 2011-11-24 15:52 2 2638
大家讨论下用system generator 还是AccelDsp DSP generator System andrewyin 2011-11-24 13:59 9 3843
请教GSM:第一次使用,不知道配置接线怎么回事. ...2 GSM 接线 AN nongfuxu 2011-11-24 13:58 20 3950
求各位爷给个modesim的安装包加** des SIM esim cause 2011-11-24 11:22 2 2665
请教: IP/VREF脚怎么配置成VREF或者IP vr ip spartan nongfuxu 2011-11-23 23:51 3 2726
modelsim支持system verilog仿真吗 modelsim System verilog sunt8707 2011-11-23 21:08 2 5010
《爱上FPGA开发——特权和你一起学NIOS II》新书预售优惠 NIOS FPGA开发 pc ilove314 2011-11-23 19:52 5 3936
求 xilinx ise 软件 XILINX 软件 se rommpen 2011-11-23 18:39 3 2404
[Quartus] 如何使用约束将一个接收模块放在接近IO脚的区域 IO 接收模块 TE wahahaabc 2011-11-23 16:04 18 7347
多的不说,一句话: 感谢GSM猴哥 GSM nongfuxu 2011-11-23 15:32 7 2524
Xilinx CPLD（XC95144XL）开发板开发板 XC95144 Hi-board 2011-11-23 09:05 1 3100
不知道配置芯片哪个价格好. Xilinx PROM 便宜还是 SPI Flash 便宜 flash ROM nongfuxu 2011-11-23 05:20 3 2424
[zz].怎样正确插拔FPGA开发板的JTAG仿真器，如USB-Blaster等？ Blaster JTAG FPGA开发板 AutoESL 2011-11-22 23:10 3 2354
读得懂verilog，但是看不懂书上综合的RTL视图，肿么办？ RTL verilog verilo zhangqixue521 2011-11-22 21:59 7 4149
ISE 12.4 se nongfuxu 2011-11-22 18:16 9 2719
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谁能推荐一个讨论比较热烈的FPGA论坛？ FPGA PGA Windmill_CN 2011-11-22 17:03 2 1760
[matlab] 求指导：怎样例化和使用IP核 ip核 Gen generator liu1teng 2011-11-22 16:53 8 8078
请教一个assign语句 FIFO FPGA inout lizardno1 2011-11-22 14:29 9 3086
求Verilog黄金参考指南电子文档 verilog 电子 verilo lxAPP 2011-11-22 14:28 10 2922
请教一下用脉冲前后沿都触发的可综合的Verilog怎么编写 verilog 编写脉冲 bucker 2011-11-22 13:03 8 3436
[Quartus] 请推荐给一片S6 XC6SLX45T、一片DDR3电路供电的芯片 ...2 DDR 电路芯片 beforewind 2011-11-21 22:33 20 5247
求取 ISE Floorplanner 讲义 LAN se AN nongfuxu 2011-11-21 15:48 4 2044
[Quartus] spartan6 lx9器件 fdr/fdc的数量 spartan6 器件 dc seamantj 2011-11-21 13:13 5 5283
问一个简单的VHDL问题，信号线上电赋初值 VHDL 信号线 PROCESS sioca 2011-11-21 12:34 3 2984
请问8bit10bit的无符号乘法器，需要耗费多少时钟周期？时钟乘法器 Actel crystal28 2011-11-21 12:28* 7 6372
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xilinx的普通IO引脚能否有类似于altera的PLLout？ altera PLL XILINX 钻研的鱼 2011-11-20 18:49 15 8634
急求设计一个奇偶较检电路谢谢！！！！电路二进制 D触发器 chenke1988 2011-11-20 16:34 0 2810
【求助！】ISE系统文件libGui_Clip.dll丢失 GUI ui se mstone3320 2011-11-20 14:40 5 7021
关于FPGA嵌入式系统设计的配置、bootloader等问题 Bootloader 系统设计嵌入式系统 vergil_gxw 2011-11-19 12:24 13 3787
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论坛周年庆活动二—“论坛之巅,谁是最权威的专家” ...2 3 赛灵思 FPGA PGA SuperX-man 2011-11-18 23:12 47 7014