本版专家: gaochy1126
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[protel] PCB外圈加了一整圈铜,接插件也用铜包起来是为什么
2015-5-16 11:13 0 1397
[PADS] PADS中的2DLINE怎么更好使用
2015-5-16 09:26 5 7494
[Allegro] 谁能给我Cadence 16.6**文件啊 attachment
2015-5-15 23:51 4 1908
[Quartus] Quartus II 9.0的简单应用  ...234
2015-5-12 09:05 60 5922
[protel] 给你想要的一切
2015-5-9 14:44 0 880
小弟要设计一个触控板,真心求助 新人帖
2015-5-9 11:31 2 597
[protel] 硬件先锋 attachment
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[Allegro] 关于16.6十字光标的消失问题 新人帖
2015-5-7 15:50 2 2219
请教EE7.9.4版本dxdesigner 设计的原理图 怎样生产PADS LAYOUT需要
2015-5-7 11:10 8 3556
[Allegro] 求助过孔的热风焊和隔离焊盘的问题
2015-5-6 22:23 3 3307
[cadence] cadence16.3/16.5在win7上走线不显示
2015-5-6 17:04 9 2785
[PADS] 新手请教关于pads logic建立元件的问题。 attach_img
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[protel] Altium Designer 2013下载分享 attachment
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[PADS] 求助 attach_img
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SDRAM工作原理和时序 attachment
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锐能微计量芯片 新人帖
2015-4-29 17:15 0 928
[Verilog HDL] 新人一枚,想下H.264 CAVLC的代码没积分? 新人帖
2015-4-29 09:59 4 641
PADS_LOGIC_转换成_OrCad mgc_ddp8_9.dll丢失 新人帖
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[Allegro] 铺铜的问题
2015-4-27 17:54 0 834
[Allegro] 新人求助~CONCEPT HDL输出网表报错 新人帖 attach_img
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[Allegro] 请教两层PCB过孔设置问题 新人帖
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请教各位大牛关于IC测试设备整机设计工程师的前景
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[Allegro] pcb edit 连线有偏差,如何修正 attach_img
2015-4-25 18:30 6 1465
[Allegro] 使用ORCAD capture 画原理图 相同的部分 作图
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[protel] 请问,altium画原理图时,选择模版后,如何去掉ALTIUM的** attach_img
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[protel] 请教高手,本人喜欢的PROTEL/DOS版,不知从哪里下
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[cadence] AVL.WORKSPACE.SUITE.V4.0
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[FPGA] Xilinx FPGA设计时序约束指南
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[Quartus] Quartus II 和 Modelsim联调是发生的错误 新人帖
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[PADS] pads新手问一个问题 attach_img
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2015-4-19 15:57 0 886
[Allegro] 第一次画PCB,导入网表出现错误
2015-4-17 14:54 9 4281
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2015-4-17 11:40 0 882
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2015-4-17 11:28 0 780
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[PADS] Pads覆铜问题求解,铜把焊盘和过孔覆盖了 新人帖 attach_img
2015-4-16 09:32 14 8518
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