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FPGA开发板咨询
FPGA开发板 ，LED ，XILINX ，控制 ，控制器
FPGA论坛 kilmty 2013-10-22 5 1867 歼飞2012 2014-1-8 09:55
XILINX Rapidio 使用探讨---我又回来了，不信整不明白这IPcore attach_img
XILINX ，RapidIO ，IPCore ，FPGA ，PGA
FPGA论坛 fenglema 2013-10-17 19 9142 AcedX 2016-3-30 09:25
xilinx spartan6 pcie控制GPIO工作量评估
GPIO ，PCIe ，spartan6 ，XILINX ，控制
FPGA论坛 iuven 2013-10-12 3 2483 41402169 2013-10-14 23:57
xilinx的DDS core可以设定幅度吗？
core ，DDS ，XILINX ，DSC
FPGA论坛 ailnyg 2013-9-26 1 1399 w998101 2013-10-14 22:41
XILINX 的 ISE ，怎么在原理图里将输入和输出直接连接起来？ attach_img
se ，原理图 ，XILINX ，AC ，端口
FPGA论坛 ngyg12 2013-9-24 4 5123 ngyg12 2013-9-25 18:53
我想计算一个多项式（xilinx verilog）
verilog ，XILINX ，verilo
FPGA论坛 ailnyg 2013-9-22 7 2250 GoldSunMonkey 2013-9-23 23:53
Xilinx与生态伙伴启动All Programmable抽象化计划
Programmable ，XILINX ，赛灵思 ，ip ，软件
FPGA论坛 GoldSunMonkey 2013-9-21 0 2344 GoldSunMonkey 2013-9-21 19:21
XILINX的AXI DATAMOVER IP CORE的问题
XILINX ，core ，ip ，ov ，AN
FPGA论坛 wahahaabc 2013-9-22 2 7277 wahahaabc 2013-9-23 22:09
xilinx floating_point这个核
FLOATING ，point ，XILINX ，TI
FPGA论坛 ailnyg 2013-9-26 1 1441 ailnyg 2013-9-26 19:09
关于xilinx的小白问题
XILINX ，ip ，ip核 ，altera ，TE
FPGA论坛 joychou 2013-10-10 8 2894 bjxdylzsts 2014-6-11 17:15
xilinx fir核仿真 attach_img
FIR ，XILINX ，仿真 ，AC
FPGA论坛 a200556220407 2013-10-22 0 1575 a200556220407 2013-10-22 23:14
XILINX 的SPARTAN6 使用从并配置，DONE不能拉高，求救！！！ attach_img
XILINX ，spartan6 ，pi ，IO ，ni
FPGA论坛 ngyg12 2013-10-29 0 3607 ngyg12 2013-10-29 11:53
如何禁止综合器讲某个信号走BUFG attach_img
信号 ，XILINX ，ST
FPGA论坛 41402169 2013-10-29 5 1899 GoldSunMonkey 2013-10-30 21:04
rom IP核的仿真问题
仿真 ，ROM ，ip核 ，se ，XILINX
FPGA论坛 JokerLone 2013-11-4 5 1987 JokerLone 2013-11-6 11:09
请教 xilinx的时序报告中的这段话是什么意思 attach_img
XILINX ，时序 ，hz ，DCM ，外部时钟
FPGA论坛 ldx521 2013-11-9 5 1891 ldx521 2013-11-13 21:20
手把手课堂:Xilinx FPGA设计时序约束指南
时序 ，FPGA设计 ，XILINX ，rio ，IO
EDA 技术 gaochy1126 2013-11-12 7 1835 gaochy1126 2013-11-12 16:40
请指教，到底是我设计有问题，还是XILINX FPGA或板有问题 attach_img
FPGA ，XILINX ，RAM ，电路 ，上位机
FPGA论坛 sme-ic 2013-11-16 7 1848 xiamingmin163 2013-11-17 21:54
谁能说说xilinx 7系列的FPGAXADC模块有啥用，怎么用
FPGA ，XILINX ，ADC模块
FPGA论坛 tianyakeliu6 2013-11-17 0 1736 tianyakeliu6 2013-11-17 17:43
Xilinx FPGA设计时序约束指南
FPGA设计 ，时序 ，XILINX ，rio ，IO
EDA 技术 gaochy1126 2013-11-27 12 3670 asasq11 2015-4-22 19:26
FPGA中的输入可以直接输出么
FPGA ，PGA ，XILINX ，信号 ，时钟
FPGA论坛 JokerLone 2013-12-1 8 1756 bu2zhouzhu 2013-12-6 14:18
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