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问下为什么看不到波形 attachment
LSI ，model ，modelsim ，SIM ，verilog
FPGA论坛 你好旅行者 2020-4-20 6 973 你好旅行者 2020-4-21 21:33
新手求助verilog
verilog ，时钟 ，数据收发 ，hz ，系统时钟
FPGA论坛 hbjdt 2016-5-30 6 1216 linfulin 2016-6-28 09:19
Verilog算法及建模整理文档 attachment
建模 ，verilog ，C语言 ，HDL ，hd
FPGA论坛 tee. 2012-9-5 6 2219 okyouwin 2012-9-7 11:27
【活动贴】Verilog HDL 综合实用教程 attachment
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EDA 技术 feihong777 2013-4-12 6 2150 yangfchn 2013-10-23 23:46
请教提高FPGA的速度
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EDA 技术 忘情天书 2008-1-3 6 3037 harlemjia 2008-1-19 18:54
verilog hdl硬件描述语言(中文教程) attachment
HDL ，verilog ，硬件描述语言 ，VerilogHDL
ZLG 想实习去 2010-1-17 6 3395 aqua2013 2016-6-10 22:01
新手准备开始学习FPGA，开发板的选择，dalao们进来给建议
FPGA ，开发板 ，硬件 ，verilog ，嵌入式
FPGA论坛 cross_stone 2017-3-17 6 1659 xiongbb 2017-5-8 07:37
verilog 求余计算，综合时出错
verilog ，ST ，constant ，IVECO ，os
EDA 技术 cc810610186 2010-5-29 6 8932 jakfens 2011-9-2 08:50
verilog_FPGA实例 attachment
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FPGA论坛 liugp25 2012-11-29 6 2546 bulonghu 2013-1-5 16:44
Verilog HDL---复杂数字系统的构成
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FPGA论坛 mucanhin 2012-11-30 6 2768 GoldSunMonkey 2012-12-2 20:07
4组数据混在一起，如何分离开来 attach_img
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FPGA论坛 paulkiyt 2018-6-12 6 1437 stickler 2018-6-18 09:04
Verilog HDL初学问题
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EDA 技术 ocon 2007-11-1 5 2471 ocon 2007-11-5 10:17
Verilog中阻塞赋值与非阻塞赋值的区别 attachment
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电子技术交流论坛 ruoyun 2013-8-7 5 2252 kingxw 2013-9-25 17:38
Verilog调试用系统任务和常用编译预处理语句
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FPGA论坛 星星之火红 2012-9-29 5 2559 GoldSunMonkey 2012-9-30 20:15
FPGA的学习帖之如何提高verilog hdl
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FPGA论坛 风源EZ 2013-1-12 5 1866 hawksabre 2013-1-16 18:00
Verilog问题
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万利电子 pkat 2013-6-29 5 1532 火箭球迷 2013-6-29 22:01
Verilog的两个误区
verilog ，阻塞 ，阻塞赋值 ，时序 ，se
FPGA论坛 xiao6666 2012-10-14 5 1984 lxAPP 2012-10-29 22:54
verilog中复位为何用下降沿
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FPGA论坛 magic_yuan 2013-4-5 6 6518 jahnson066 2013-4-6 13:40
【活动贴】verilog attachment
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EDA 技术 feihong777 2013-4-11 6 2016 panjunren 2013-10-20 22:06
应届生提问：通信算法工程师和FPGA工程师哪个发展前景好？
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FPGA论坛 夏洛特的网ge 2017-11-13 6 4329 原子弹001 2017-11-15 18:16
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