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请教应该怎样加约束? ...2 3 时钟 DAC AC nongfuxu 2012-3-22 13:31 41 5419
Error:NetlistWriters:415 - The design contains secured core(s)..." AI RS 星星之火红 2012-2-19 17:27 2 2221
[verilog] 7系列的封装兼容性呢？ XILINX 星星之火红 2012-3-26 20:51 10 4598
[matlab] 13.4版本 EDK中下载遇到Data2MEM的问题，求解答急！ boot ce ic jennyzheng 2012-2-20 15:54 8 4351
真的糊了,DCM输入时钟约束到底该按哪个计算? DCM 时钟 hz nongfuxu 2012-2-20 14:16 6 2045
[matlab] StateCAD异步Reset报错 statecad 异步 Reset lizardno1 2012-2-17 21:11 2 2008
华为授予赛灵思“2011年度核心合作伙伴”大奖华为赛灵思华为公司 SuperX-man 2012-2-18 19:21 11 2258
点击时序约束编辑器老说已经运行了,怎么回事? 时序编辑器 AC nongfuxu 2012-2-17 19:41 3 2386
[CPLD] 乘法器的时钟裕量显示不够,请教怎么处理啊? 乘法器时钟 AC nongfuxu 2012-2-18 12:56 16 3493
请教ISE中如何进行多周期约束? se nongfuxu 2012-2-18 12:52 5 2809
赛灵思十余款28nm产品将于2012年中期下线赛灵思台积电 hp xlhtracy 2012-2-28 12:37 4 1834
介绍一下哪里有好的Moselsim6.5下载 LSI MOS SIM jakfens 2012-2-19 14:04 8 2094
求助：读取fifo的数据问题？ FIFO ip核 ip mxjtracy 2012-2-28 11:10 6 2815
两种处理方式，哪种更好电流供电 Pulse entepino 2012-3-10 12:48 4 1960
求助IP核生成的fifo控制问题.. FIFO ip核控制 mxjtracy 2012-7-18 20:29 6 2816
热烈庆祝“TOTO无烦忧”晋升为三级X-MAN AN 赛灵思 FPGA SuperX-man 2012-2-16 22:10 7 2255
[matlab] 请教：ISIＭ能否根据条件编译有选择地显示变量编译仿真 testbench nongfuxu 2012-2-14 21:05 1 2281
ISE中编译仿真库问题 se 编译仿真 memory130 2012-2-24 23:22 1 2002
ISIM不能像MODELSIM那样用曲线显示数据. LSI model modelsim nongfuxu 2012-2-14 14:37 0 2137
fpga入门知识：fpga是什么意思？ ASIC是什么意思？ ...2 ASIC FPGA 编程 xlhtracy 2012-2-16 16:40 24 4418
如图modelsim时序仿真时波形上方message行的红色提示什么？时序 message modelsim loveajia 2012-2-22 13:57 7 3855
请教GSM有关模块例化的问题 GSM FIFO TE 铁蛋gg 2012-2-12 08:46 4 2259
猴哥：modelsim6.5c 和modelsim6.5se区别 modelsim se edacsoft 2012-2-22 19:09 17 3461
喜讯连连-XILINX入围2012 UBM年度电子成就奖 ...2 XILINX 电子赛灵思 SuperX-man 2012-2-15 08:59 20 3200
中兴通讯授予赛灵思“2011 年最佳综合绩效奖” 赛灵思 XILINX SuperX-man 2012-2-16 20:32 11 2613
FPGA基础之时序设计 FPGA 时序设计时钟 xlhtracy 2013-1-31 10:11 7 2082
请教一个FIFO时序是否会发生冲突 FIFO 时序时钟 lizardno1 2013-3-27 14:38 19 4603
QUARTUS 封装模块调用问题--求助 Gen como 2012-2-8 13:16 1 5272
[VHDL] 100币以下的，哪款xilinx芯片最强劲？ XILINX 芯片 reconfig_alic 2012-2-12 19:25* 13 2587
Linux操作系统跑Xilinx工具用什么配置的电脑好 XILINX 电脑 Linux操作系统 jennyzheng 2012-2-9 14:11 11 3113
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[Quartus] 【求助】JTAG链路出了问题，应该怎么排查？ JTAG AC AI sleepybear 2012-2-9 16:14 14 2844
quartus中permanently enabled警告如何处理？ LED BLE chinaitboy 2012-2-10 12:57 3 5770
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X家S6 输出时钟需要走全局时钟管脚吗？时钟管脚 edacsoft 2012-2-3 12:51 4 2058
赛灵思第一批7系列目标设计平台正式上市了 ...2 3 赛灵思 PGA FPGA SuperX-man 2013-2-23 20:21 44 7817
求virtex-4 系列下的XC4VFX60FF1152的IBIS仿真模型。求助! virtex 仿真模型星星之火红 2012-2-3 12:48 8 2022
各位，有没有带千兆网接口的fpga开发板卖？接口 FPGA开发板千兆网 chinaitboy 2012-2-27 13:10 8 3088
[Quartus] DDR controller Controller DDR why2009a 2012-2-1 11:54 7 2909
需要Uart的IP核，求帮助 ip核 UART ip 星星之火红 2012-2-1 11:51 8 2254