本版专家: gaochy1126
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[PADS] LAYOUT里面铺铜了,router里面是空心的? attach_img
2013-9-26 11:39 8 5191
[protel] 关于PCB覆铜之后变大无法保存 的问题??? attach_img
2013-10-9 09:07 17 2227
FPGA高手经验之谈 attachment
2013-9-20 21:58 2 1668
[PADS] 请教PADS layout导线拐角处出现小方框是什么意思? attach_img
2015-6-10 16:54 7 13565
[protel] altium 中使用harness处理总线bus时 编译出错 attach_img
2016-7-28 14:38 4 4843
[FPGA] FPGA脉冲产生的问题
2013-9-16 21:13 0 1814
[protel] 这个形状的边框如何覆铜 attach_img  ...2
2013-10-28 19:49 20 6695
求问计数器计数值怎么确定的?
2013-10-25 16:59 7 1915
[ISE] LCD1602 语法没错误,但都是警告。。新手小弟求帮忙 attachment
2013-10-25 14:35 6 2139
VALOR DFM check
2013-9-13 00:25 2 1734
[protel] 在protel99中如何把若干个元件等间隔的排成一条线?求解答!
2013-9-27 07:55 11 4869
[protel] 求教??//
2013-9-11 20:58 2 1935
请教各位大神,这是怎样的一款IC?
2013-10-14 15:35 4 1715
小功率MOS管发热的问题
2013-9-23 13:03 10 2457
[protel] altium designer绘制原理图时图形的层次问题
2014-5-12 19:51 3 2246
[protel] 请问在AD6.9中mid-layer有何作用?
2013-9-9 09:50 2 4755
[Allegro] 安装CadenceAllegro16.5完,打开出现错误,求帮助 attach_img
2013-9-6 13:32 6 2383
[PADS] 初学PADS,画图边角怎么是折线? attach_img
2013-11-6 11:38 3 1972
[protel] PCB布线问题 attach_img
2013-9-9 09:33 5 1957
multisim仿真波特图与实际计算不符合,请教各位!~~ attach_img
2013-10-31 23:53 6 2519
请教EE7.9.4版本dxdesigner 设计的原理图 怎样生产PADS LAYOUT需要
2015-5-7 11:10 8 3860
关于EDA软件的问题
2013-9-10 00:38 5 1600
[protel] AD09打印输出的问题 attach_img
2013-9-9 09:38 12 5266
[protel] Altium Designer 10画不了圆弧走线 attach_img  ...2
2018-11-28 18:40 30 32148
[Allegro] cadence过孔怎么对齐?bga表层到过孔好多有折线~
2013-8-27 12:47 1 2865
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2013-8-29 21:27 7 1606
cadence Allegro中在制作零件庫時Pad與其PIN_NUMBER不重合 attach_img
2013-8-30 21:46 7 1950
下载的资料报错 attachment
2013-8-25 20:50 6 1548
丝印转pdf,怎么让要显示的丝印图铺满整个纸张 attach_img
2023-3-9 17:08 11 5682
[Allegro] 双层FPC,求走线高手指点 attachment
2013-8-28 11:38 2 2039
关于sof文件和pof文件
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2013-8-24 23:10 1 1434
AV的信号是多大的频率?哪位知道?
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[cadence] Cadence16.6 网表错误,提示无效指针!
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[PADS] CAE封装,如何让管脚中间对齐?期待高手解答 attach_img
2013-8-28 08:16 3 2495
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2013-8-21 08:06 1 1690
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