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inout 双向数据口,前仿和门级仿真都通过了,时序仿真就是 attach_img
2013-1-13 12:20 16 3463
[CPLD] 奇怪了,spartan-3a接DDR内存只能使用x8不能用x16
2013-1-13 10:13 1 2524
verilog学习五点经验分享 agree  ...2
2013-1-13 09:23 22 3360
刚转投xilinx,还真不习惯,求指点 attach_img
2013-1-13 09:22 15 2430
基于FPGA的级联结构FFT处理器的优化设计
2013-1-13 09:16 17 3204
请帮看一下CPLD完成4路视频输入1路输出分割显示,有原理图 attach_img
2013-1-12 23:01 10 4292
技巧分享:Xilinx FPGA全局时钟和第二全局时钟资源的使用方法
2013-1-12 22:57 4 2494
Virtex-5推动超宽带通信和测距的发展
2013-1-12 22:56 6 1921
基于赛灵思Spartan-3E FPGA的磁浮轴承控制系统研究
2013-1-12 22:56 7 1917
基于FPGA的微型数字存储系统设计
2013-1-12 22:53 5 1884
用FPGA 嵌入式处理器实现高性能浮点元算
2013-1-12 22:53 7 1814
跪求大神帮助用VHDL做7分频时钟电路产生
2013-1-12 22:50 6 2123
如何在Vivado HLS设计中定义AXI4接口
2013-1-12 22:48 1 1754
抛却细节是应对工程知识大幅过时大幅良策吗?
2013-1-12 22:48 0 1519
设计技巧:用matlab来实现fpga功能的设计
2013-1-12 22:46 8 2098
经验分享:如何选购FPGA 开发板  ...2
2013-1-12 22:46 23 4002
初学FPGA,学的是Verilog,遇到问题请大神们给解答!
2013-1-12 22:45 5 1983
赛灵思Spartan®-6 FPGA 工业以太网套件介绍
2013-1-12 22:45 2 1991
FPGA管教分配需要考虑因素
2013-1-12 22:45 3 1806
基于赛灵思Virtex5的PCI-Express总线接口设计
2013-1-12 22:45 11 2735
如何用赛灵思FPGA构建智能监控视频分析系统
2013-1-12 22:39 3 2116
基于赛灵思Virtex-4的可重构计算硬件平台改进设计
2013-1-12 22:39 3 1617
跪求解决问题:用FPGA控制AD7656
2013-1-12 22:39 3 2713
基于赛灵思FPGA和MCU结构的线性调频高度表
2013-1-12 22:38 8 2069
一种基于Modelsim FLI接口的协同仿真技术
2013-1-12 22:37 0 1897
如何设置多周期路径
2013-1-12 22:31 3 1412
VHDL程序求解 attach_img
2013-1-12 22:31 5 2101
cpld怎样接晶振?
2013-1-12 22:30 10 5136
Lattice将在CES 2013上展示基于LatticeECP3的实时3D视频转换器
2013-1-12 22:29 3 2441
基于FPGA和LVDS技术的光缆传输技术
2013-1-12 22:28 0 2155
基于MicroBlaze软核的液晶驱动程序设计
2013-1-12 22:27 4 1912
MicroBlaze性能详解
2013-1-12 22:27 2 1638
利用赛灵思FPGA设计基于JTAG边界扫描方式的重构控制器
2013-1-12 22:27 3 2222
基于赛灵思FPGA的航空总线协议接口设计
2013-1-12 22:26 6 2196
设计技巧:基于赛灵思Spartan-3A DSP的安全视频分析
2013-1-12 22:26 8 1895
硬件失效原因之:PCB焊接
2013-1-12 22:23 15 2835
FPGA在智能压力传感器系统中的应用设计
2013-1-12 22:22 0 2030
基于赛灵思FPGA和SRAM的数控振荡器的设计实现
2013-1-12 22:00 12 2124
确保Virtex-5 DDR2 存储器接口的信号完整性 attachment
2013-1-12 21:59 5 2091
浅析FPGA Editor如何提升设计效率
2013-1-12 21:59 8 1626
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