今日: 1|主题: 14200|帖子: 104295 收藏 (179)
给程序挑错
2013-1-2 18:18 4 966
这是什么情况?怎么结贴给分啊? attach_img
2013-1-2 18:17 3 1013
不关心的值怎么处理
2013-1-2 18:08 1 1286
谁可以帮忙解释一下FPGA上载方面的问题
2013-1-2 18:03 7 1461
Xilinx FPGA 电路配置(转)
2013-1-2 18:01 9 3811
Error: Can't place node
2013-1-2 14:20 6 2640
新年好,请大侠帮我个忙,把寄存器的数据保存到文档。
2013-1-2 11:44 1 1695
模块例化端口问题
2013-1-1 23:59 4 1383
[FPGA] 很便宜的一个视频开发板
2013-1-1 23:58 5 1760
《从零开始走进FPGA世界》下载! attachment  ...23456
2013-1-1 21:31 105 12690
视频:Verifying your Vivado HLS Design
2013-1-1 12:39 17 1645
[VHDL] Virtex-5 2 byte, single lane GTP Aurora(2位单通道GTP Aurora)实例 attachment  ...2
2012-12-31 22:20 32 5786
解决ModelSim显示中文乱码
2012-12-31 21:55 2 4950
赛灵思多模无线电目标设计平台详解
2012-12-31 19:56 11 1386
有关赛灵思基于ARM处理器处理架构的16个疑问  ...2
2012-12-31 19:04 27 2480
跪求FPGA开发板的资料
2012-12-31 18:55 3 1696
视频:Vivado设计套件的消息、报告、日志功能演示 agree
2012-12-31 16:42 11 1449
转帖:Matlab中FDATool工具箱的滤波器设计及相关文件的生成 digest agree
2012-12-31 16:37 9 5399
在FPGA中,如果进行时序约束
2012-12-31 16:34 6 1758
求选型
2012-12-31 09:05 2 2411
自己写的johnson计数器出问题了
2012-12-30 22:31 2 1717
当有需要上升沿触发要怎么处理
2012-12-30 22:30 2 1472
一个二进制转BCD的问题,请大家分析
2012-12-30 22:16 2 1807
串口问题几个疑问
2012-12-30 22:13 2 1456
我得cmd有什么问题,请大家看看?
2012-12-30 22:13 2 922
发个帖子吐个槽,问题找到了。蛋疼的赛灵思,蛋疼的ISE
2012-12-30 21:50 8 1393
Modesim错误
2012-12-30 21:47 1 2180
从EPCS加裁NIOS
2012-12-30 21:37 1 1451
[matlab] 求助FPGA中的条件编译问题
2012-12-30 21:27 5 1760
关于signal tap ii的问题
2012-12-30 21:01 1 1283
所有的register都为unconstrained
2012-12-30 19:15 1 1556
我与赛灵思的2012+爱上你才有未来 attachment  ...2
2012-12-30 18:56 23 2567
如何将ucfs文件系统植入nios ii工程中?
2012-12-30 18:05 1 1258
[VHDL] 如何进行xilinxFPGA的后仿真 attachment
2012-12-29 23:42 17 4746
心血来潮想问问EDK的使用?
2012-12-29 23:23 3 1261
为何选择Zynq-7000 All Programmable SoC agree
2012-12-29 23:22 6 1503
XC6VSX475T-FF1156几层PCB能走通?
2012-12-29 23:21 10 2288
[matlab] 今天遇到了一个超级奇怪的问题 关于ISE 13.2的 请教各位大侠 attachment  ...23
2012-12-29 21:45 43 8345
我与赛灵思的2012+初次与你相恋 attach_img  ...2
2012-12-29 11:59 20 2421
我与赛灵思的2012++我学习我快乐  ...2
2012-12-29 10:02 22 2563
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