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如何初步测试FPGA的电源阻抗?
2013-1-10 18:25 1 1874
新手求帮助:怎样用指定的LUT实现某一逻辑功能
2013-1-9 23:50 7 1956
[matlab] 100VHDL的例子 attachment
2013-1-9 23:02 3 2392
请教:如何使FPGA内部产生的一个时钟信号从多个引脚输出
2013-1-9 23:01 1 2455
Nexys3 Board上的VHDC是干嘛用的?? attachment
2013-1-9 17:45 6 2643
华为硬件工程师手册_全 attachment
2013-1-9 08:42 8 7289
[Quartus] 该怎么弄?
2013-1-8 23:44 5 2223
[CPLD] SPARTAN3A 的DDR2接口设计
2013-1-8 20:37 2 2386
谈谈提高FPGA设计生产力的工具、技巧和方法 agree
2013-1-8 20:36 13 2482
[Quartus] 基于FPGA的高速同步HDLC通信控制器设计
2013-1-8 20:35 6 3081
[CPLD] 设计Spartan-3 FPGA DDR存储器接口 attachment
2013-1-8 20:28 4 2543
[Quartus] 基于FPGA的传统DDS方法优化设计
2013-1-8 20:25 3 2132
悬挂运动控制系统
2013-1-8 20:25 12 3554
[Quartus] 基于PCIe总线的超高速信号采集卡的设计
2013-1-8 20:21 3 2138
求助:spartan6的配置问题 attach_img  ...2
2013-1-8 11:45 20 4604
我与赛灵思的2012 我与Xilinx随便都可以说的事情 attach_img  ...2
2013-1-8 11:22 29 4564
我与赛灵思的2012+我和你一起走过的日子 attach_img
2013-1-8 11:08 9 2087
基于FPGA的函数信号发生器的设计与实现 attachment
2013-1-8 10:38 17 3053
[matlab] fft ip核使用问题 attach_img
2013-1-7 21:02 9 4610
[VHDL] Microblaze 加VGA驱动IP attachment
2013-1-7 09:16 6 2184
ise10.1打不开旧版本文件,怎么解决呀 attach_img
2013-1-6 23:22 5 2225
视频:开始使用Vivado高层次综合工具(HLS)
2013-1-6 20:37 15 2746
视频:IO引脚规划功能介绍
2013-1-6 20:37 16 2342
[Quartus] 求二手Nexys3 Spartan6 开发套件
2013-1-6 20:36 4 2494
用PLL做分频有必要吗?
2013-1-6 20:35 4 2533
ISE约束文件*.ucf的写法
2013-1-6 20:29 9 4163
Verilog的数据类型
2013-1-6 20:28 13 3061
FPGA验证简介
2013-1-6 20:27 3 2132
准备申请 Nexys3,出现如下信息,有戏没? attach_img
2013-1-6 17:59 6 2019
X-FEST 2012资料发布 digest agree
2013-1-6 16:27 10 2718
【请教】quartus仿真时遇到的一个奇怪问题。 attachment
2013-1-6 13:22 18 2707
如何使用XDC时序约束编辑器 digest agree
2013-1-6 11:55 0 3224
我与赛灵思的2012+可编程逻辑器件(PLD)认识与使用初步 attach_img
2013-1-6 11:17 7 2653
Xilinx USB下载线 attach_img
2013-1-5 23:01 11 2860
[Quartus] FPGA的宽带步进频率信号源设计
2013-1-5 23:00 4 2666
verilog_FPGA实例 attachment
2013-1-5 16:44 6 2522
[VHDL] 有谁研究过【V5】的【组播报文】接收问题?
2013-1-5 16:41 3 2264
我与赛灵思的2012--在领先一代的All Programmable产品中快乐前行 attach_img agree  ...23456..9
2013-1-5 13:48 170 17773
自己设计的基于FPGA的数字处理板,大家提提意见 attachment
2013-1-5 11:13 8 2168
求取模软件
2013-1-5 10:22 3 2162
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