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FPGA设计的基本原则、技巧与时序电路设计
2012-12-27 08:23 12 1985
LTE基带目标设计平台方案详解
2012-12-26 22:44 5 1248
调试DDR2弹出的错误 attach_img
2012-12-26 22:42 5 2636
我与赛灵思的2012+原来是你
2012-12-26 22:24 2 1636
外包一个FPGA实现IDE(主机、从机)的项目  ...2
2012-12-26 15:11 24 3806
新手问:vhdl中,integer(n/2)是怎么用的?
2012-12-26 13:14 0 1351
ALTERA要放弃低端市场了吗?  ...2
2012-12-26 11:52 26 4101
ISE和MATLAB怎么连用
2012-12-26 10:53 8 7544
降低FPGA功耗的设计技巧
2012-12-26 10:28 1 1909
Virtex-5系统功耗设计的规则 attachment  ...2
2012-12-26 10:16 24 3190
VHDL状态机驱动两片74HC595遇到问题。
2012-12-26 09:56 2 2455
[VHDL] 用XilinxFPGA实现DDRSDRAM控制器 attachment agree
2012-12-25 23:47 4 1867
Xilinx FPGA设计约束的分类
2012-12-25 23:06 10 2059
[matlab] 我的ISE开始菜单中缺少很多工具
2012-12-25 21:08 15 1892
三个全新 Vivado 高层次综合应用指南
2012-12-25 18:03 1 1035
有没有用FPGA做过FM/FSK解调的?
2012-12-25 16:11 5 2174
[Quartus] Latency 究竟是多少? attach_img
2012-12-25 14:30 11 2330
如何结贴 attach_img
2012-12-25 11:49 5 2263
基于FPGA的毕业设计
2012-12-25 10:03 5 2619
求助!FPGA 除法 混合运算 attachment
2012-12-24 23:19 18 4744
FPGA设计的高速FIFO电路技术
2012-12-24 23:18 13 1716
FPGA在DSP领域的应用
2012-12-24 23:17 7 1659
[matlab] 纯小白在写作业,可是map过不去?报错啊。。。求助!!! attachment  ...2
2012-12-24 22:07 23 3415
maxplus 引脚配置后编译报错,求高手帮助,谢谢!
2012-12-24 22:01 2 1740
ALteral 的浮点除法IP 仿真
2012-12-24 22:01 1 1072
full_case避免综合出锁存器? attach_img
2012-12-24 22:01 13 3166
ARM与XILINX十几年的恩怨情仇
2012-12-24 21:58 7 1788
如何解决FPGA电路设计中的毛刺问题
2012-12-24 21:58 14 1988
基于模块化设计方法实现FPGA动态部分重构
2012-12-24 21:56 5 1441
FPGA的可重构测控系统应用设计
2012-12-24 21:56 7 1367
我与赛灵思的2012--我和你一起走过的日子
2012-12-24 21:50 7 1172
基于赛灵思FPGA的快速9/7整形离散小波变换系统设计
2012-12-24 17:52 5 1187
modelsim SE 10.1 添加Altera仿真库器件cycloneive_atoms.vhd出错。 attach_img
2012-12-24 15:20 3 2792
altera_mf_87.vhd 在Quartus12.0里面没有了,是怎么回事?
2012-12-24 14:53 0 1213
提升创造力的数字设计工具 FPGA Editor
2012-12-24 13:38 7 1397
[Quartus] 关于时钟使能的疑问
2012-12-24 11:32 9 2153
[Quartus] modelsim 10.1a 和 10.1c 有哪些区别? 谢了!
2012-12-24 10:40 4 3470
[Quartus] spartan6 一个BANK 支持两片DDR2不?  ...2
2012-12-24 00:09 39 6708
应对串行背板接口设计挑战
2012-12-23 22:46 10 1665
APU用法分步指南
2012-12-23 22:46 7 1330
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