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今日: 0|主题: 14278|帖子: 104595

[verilog] 当周期信号上升沿来时,如何用时钟对其进行计数 attach_img
2014-10-11 23:42 6 1655
有谁搞过AFDX吗?
2014-10-9 19:37 2 1099
如何在Modelsim仿真中显示状态机名称
2014-10-9 19:31 8 3260
chipscope数据导入matlab attachment
2014-10-8 19:59 13 5167
FPBA模拟输出编码器信号 attach_img
2014-10-8 18:15 5 1477
[FPGA] Spartan6 DDR控制器calib_done无法拉高
2014-10-8 12:19 2 1650
[modelsim] chipscope抓取信号
2014-10-8 11:18 4 3867
[FPGA] Spartan 6 一个bank上的DDR硬核和其他IO口可以同时使用吗?
2014-10-8 09:11 1 1150
如何使用inout引脚的输入输出
2014-10-7 20:47 1 1606
[FPGA] 请教FIR滤波器的问题
2014-10-6 12:01 7 1709
[FPGA] 需要几个5输入LUT组成一个6输入LUT,画出示意图
2014-10-2 10:34 4 2815
[FPGA] 我用DSP C5509A的GPIO口接入ov7670摄像头,需要用到SIOC和SIOD吗?
2014-10-2 10:25 3 2164
[CPLD] 采样后的数据抖动一个采样时钟周期 attach_img
2014-9-30 16:37 3 1371
FPGA内核1.2v电压问题
2014-9-30 10:23 10 7088
CPLD的用作按键的输入口损坏,是静电造成的吗
2014-9-29 16:59 1 1247
VHDL程序的仿真测试文件
2014-9-29 13:06 5 1377
求ADI TS201和FPGA通信参考设计 attachment
2014-9-28 18:54 19 3515
[Quartus] SPARTAN6 FPGA的SPI模式下载遇到麻烦,请大家指点 attach_img
2014-9-28 17:45 10 2630
[FPGA] 基于MicroBlaze软核的液晶驱动程序设计
2014-9-28 16:24 3 1811
[FPGA] PCB板材选取与高频PCB制板工艺要求 attachment
2014-9-28 16:01 1 899
MicroBlaze性能详解
2014-9-28 11:29 1 1762
[FPGA] 学哪家的FPGA比较好
2014-9-26 21:18 13 2014
FPGA时序
2014-9-26 17:23 12 2944
关于memory数据类型的时序收敛
2014-9-24 22:02 2 1258
[FPGA] UT_4412BV02评估板配10.1寸电容屏现只售1500
2014-9-24 15:48 0 1190
[CPLD] 友坚恒天三星UT-Exynos4412四核开发板
2014-9-24 15:47 0 1365
[modelsim] 友坚恒天三星UT2416BV02开发板配7寸电阻屏现只售530
2014-9-24 15:46 0 1249
求翻译。。求帮助
2014-9-23 17:49 0 972
stm32 能否隔着CPLD读取SRAM? attach_img
2014-9-23 17:27 14 2967
[FPGA] 欢迎参加X-fest2014研讨会!
2014-9-23 14:26 1 1577
xilinx
2014-9-23 14:07 1 958
[FPGA] FPGA 外部复位引脚 不接会怎样?
2014-9-21 23:11 5 2492
sdram存储速度问题
2014-9-20 23:47 6 1231
tri mode mac 是什么意思?
2014-9-20 22:09 3 1842
VHDL怎么存储数据??
2014-9-20 22:08 5 1339
EPM7128S IO Banks问题
2014-9-20 21:30 0 1111
[CPLD] 关于双功能引脚问题
2014-9-20 13:23 1 1077
请教两个关于LVDS的问题
2014-9-19 23:16 1 1195
[verilog] 请教双向端口顶层与底层连接的逻辑设计 attach_img
2014-9-18 23:14 2 1364
[verilog] 在读写ddr2的时候,DQS信号怎么用,可不可以不用
2014-9-18 23:03 4 2694
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