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ISE警告 attach_img  ...2
2013-7-21 20:57 22 4087
matlab生成mif文件,帮助第一次用的朋友们
2013-7-21 20:56 9 2047
FPGA工作发烫  ...2
2013-7-20 21:06 21 6009
Xilinx SDK开发工具中的.MFS文件 和相应的地址是什么意思 attach_img
2013-7-20 20:58 3 3092
赛灵思PicoBlaze软核介绍
2013-7-20 20:56 5 1693
quartus 编译的一点小问题  ...2
2013-7-20 20:52 23 3132
Virtex-5推动超宽带通信和测距的发展
2013-7-20 20:50 4 1835
赛灵思ASIC等级FPGA开始投片
2013-7-20 20:38 2 1545
Quartusii中使用了SignalTap后,仿真无法进行 attach_img  ...2
2013-7-20 20:10 20 5289
FPGA个别引脚烧坏的情况
2013-7-20 20:10 7 2021
VHDL分频小程序 attach_img
2013-7-20 20:06 6 1795
image network download的问题 attach_img
2013-7-20 20:05 9 1879
赛灵思Virtex-5推动超宽带通信和测距发展
2013-7-18 22:01 0 2025
利用赛灵思Spartan-3A FPGA搭建高等级视频监控系统
2013-7-18 22:01 0 1655
利用FPGA开发板进行ASIC原型开发的技巧
2013-7-18 21:59 0 4479
经验分享:如何选购FPGA 开发板
2013-7-18 21:59 0 992
添加时序约束的技巧分析
2013-7-18 21:57 0 1443
基于赛灵思Spartan-3E的片上系统无线保密通信终端设计
2013-7-18 21:56 0 1627
用FPGA内嵌的锁相环资源实现分频
2013-7-18 21:49 2 2147
基于FPGA的防盗定位追踪系统设计
2013-7-18 21:49 2 1534
基于赛灵思FPGA的出租车计价器设计
2013-7-18 21:49 2 1984
基于赛灵思FPGA和SRAM的数控振荡器的设计实现
2013-7-18 21:48 1 1536
赛灵思FPGA的芯片架构分析
2013-7-18 21:42 2 1638
大一点的FPGA动不动就30A,60A的电流,那2000T得多大功率 attach_img
2013-7-18 12:11 13 3690
[matlab] ISE 一些tips
2013-7-18 00:11 15 4998
怎么让pcie与1394b建立连接,实现数据传输
2013-7-18 00:11 3 1694
microblaze FSL: MapLib:979 - LUT6 symbol
2013-7-18 00:10 2 4103
verilog如何产生这样的信号
2013-7-18 00:07 2 1967
CPLD/FPGA可以用133M的晶振么
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SP6 DDR、GTP总结 digest
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verilog程序解释
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仿真很重要  ...2
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硬件项目设计心得  ...2
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Altera SoC FPGA提升整体性能 降低开发成本
2013-7-17 23:45 2 1476
弱弱的提问一下,怎么在ISE 12.3 Xlinx Platform studio 设置不用的
2013-7-17 23:40 1 1564
FPGA个别引脚烧坏的情况
2013-7-16 19:05 0 1280
FPGA个别引脚烧坏的情况
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求解在xc6slx16-3csg324上microblaze软核上axi_s6_ddrx控制器的设置
2013-7-13 14:03 1 2081
Xillinx 的20nm All Programmable 器件开始投片
2013-7-13 13:31 0 1659
分享:任意奇数分频(50%占空比) verilog 代码 attach_img agree
2013-7-12 19:49 17 4183
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