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【求助】硬件实现协议卸载
2013-8-22 21:27 1 1360
chipscope触发条件设置 attachment
2013-8-22 21:18 14 7248
spartan6和virtex6开发难度一样吗
2013-8-22 21:09 4 2245
Microblaze 从 UART 接收数据例程
2013-8-22 19:31 1 3891
【求助】硬件实现协议卸载
2013-8-22 15:24 1 1176
quartus ii 11.0的toggle rate在哪里设置?
2013-8-22 10:56 0 2535
rom 查找表
2013-8-21 22:16 3 1709
PCIE core的ucf约束文件
2013-8-21 14:53 3 2352
关于DDR2的布线
2013-8-20 22:13 4 2828
[FPGA] FPGA问题(这标题) attach_img
2013-8-20 19:57 2 1610
[FPGA] FPGA实现等效采样的时钟问题
2013-8-20 19:47 0 1464
怎么知道xilinx库函数中包括哪些component?
2013-8-20 15:08 0 1348
[FPGA] FPGA是什么?FPGA现状?怎样学习FPGA?
2013-8-20 15:04 2 1875
FPGA是什么?FPGA现状?怎样学习FPGA?
2013-8-20 10:31 0 1268
[CPLD] 请教廉价CPLD实现I2C的方案
2013-8-20 08:30 6 2325
[modelsim] 用ise14.2的几个错误怎么解决
2013-8-20 08:17 2 4111
[FPGA] Fpga低温出现故障,部分逻辑出现异常
2013-8-20 08:13 5 5040
[FPGA] altera ddr ip的问题,cyclone4是否不支持ddr sdram的ip? attachment
2013-8-20 08:11 3 2435
求基于FPGA的(DDS)任意信号发生器????
2013-8-20 08:10 3 2379
PGA选型
2013-8-19 21:30 9 2329
基于DDS的任意信号发生器设计 attachment
2013-8-19 19:21 8 2729
verilog 程序,新手,求指点 attach_img
2013-8-19 10:48 2 2050
[Quartus] TimeQuest中状态机的状态输出被当做基本时钟是为什么? attach_img
2013-8-19 10:13 1 2547
[FPGA] 电路的逻辑出现错误?
2013-8-19 08:14 2 1519
vivado使用遇到问题,求解答。
2013-8-18 18:46 0 2301
[verilog] 一个关于AD828的驱动程序,求各位大神指教指教一下
2013-8-18 16:14 9 2300
三段式verilog状态机,写好状态机还真不容易,求指导
2013-8-17 23:29 0 1435
加载程序在复位后为何还存在 attach_img
2013-8-17 13:37 6 1629
[CPLD] 请教关于晶振给fpga提供时钟的问题  ...2
2013-8-17 09:48 36 12963
[FPGA] 赛灵思的片子,对信号取反竟然有错误,有图,请教各位 attach_img
2013-8-16 17:56 14 3416
[FPGA] 有谁用过xilinx的FFT核么?
2013-8-16 17:38 0 1900
[FPGA] sdram在连续写和非连续写的时候有什么差异呢?
2013-8-16 16:53 2 1779
[FPGA] 求助开发板怎么选
2013-8-16 10:27 4 1582
[FPGA] FPGA设计常用IP核-锁相环--FPGA入门视频教程
2013-8-16 10:21 2 1861
关于ISE14.5的iMPACT
2013-8-16 09:44 0 1484
FPGA 彩屏 触摸屏
2013-8-15 20:30 1 1278
跨时钟域问题 attachment
2013-8-15 18:38 4 2299
LVCMOS25的问题
2013-8-15 10:46 3 4657
关于FPGA烧写模式的问题
2013-8-15 09:55 3 2354
刚推出一个 n 合 1 调试器,给大家过过目 attach_img  ...2
2013-8-15 09:44 29 4275
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