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verilog中的井号
verilog ，TE ，meter ，tc ，verilog代码
FPGA论坛 274643473 2011-12-15 13 9559 GoldSunMonkey 2011-12-23 19:05
fpga 语句执行时间？fpga与cpu的关系？
CPU ，FPGA ，verilog ，verilo ，counter
FPGA论坛 dami270568577 2011-12-7 5 3747 summerxue 2011-12-24 00:56
Verilog HDL--有限状态机 attachment
HDL ，verilog ，有限状态机
ZLG plato_yu 2011-12-5 2 1414 yangli1981 2011-12-5 14:10
verilog--虚拟器件和虚拟接口模型 attachment
verilog ，器件 ，接口 ，模型 ，verilo
ZLG plato_yu 2011-12-5 2 1680 xlhtracy 2011-12-20 12:51
不同抽象级别的Verilog HDL模型 attachment
HDL ，verilog ，模型 ，verilo ，hd
ZLG plato_yu 2011-12-5 1 1428 jasonyan 2011-12-5 13:49
verilog---基本运算逻辑， attachment
verilog ，verilo ，Verilog语言
ZLG plato_yu 2011-12-5 0 1323 plato_yu 2011-12-5 12:50
Verilog HDL---数字信号处理，计算，程序 attachment
HDL ，verilog ，数字信号处理
ZLG plato_yu 2011-12-5 1 2006 thlight 2011-12-20 15:17
Verilog HDL---CPU技术简介---附件 attachment
CPU ，HDL ，verilog ，VerilogHDL
FPGA论坛 后来的我们 2011-12-5 18 1675 GoldSunMonkey 2011-12-6 21:06
Verilog HDL设计方法概述 attachment
HDL ，verilog ，verilo ，hd ，VerilogHDL
FPGA论坛 后来的我们 2011-12-5 46 3884 anqier1 2012-2-15 17:21
夏宇闻fpga教程:Verilog HDL的基本语法 attachment
HDL ，verilog ，FPGA教程 ，VerilogHDL
FPGA论坛 后来的我们 2011-12-5 9 1676 tikelu 2011-12-6 20:40
夏宇闻老师谈FPGA学习整理
FPGA ，工程师 ，verilo ，verilog ，软件
FPGA论坛 后来的我们 2011-12-5 37 3830 GoldSunMonkey 2011-12-26 23:31
作为初学者应该如何来学习FPGA
FPGA ，ic ，电路 ，编程 ，verilog
ZLG wksljx 2011-11-30 0 1378 wksljx 2011-11-30 20:05
LVDS程序请教 attachment
LVDS ，verilog ，串并转换 ，verilo ，ps
FPGA论坛 lczhoujq 2011-11-29 26 3438 tikelu 2011-12-3 21:11
VHDL语言简单的教程 attach_img
vhdl语言 ，TE ，IEEE ，verilog ，verilo
FPGA论坛 GoldSunMonkey 2011-11-26 44 4977 GoldSunMonkey 2011-12-11 13:59
读得懂verilog，但是看不懂书上综合的RTL视图，肿么办？
RTL ，verilog ，verilo ，FPGA ，PGA
FPGA论坛 zhangqixue521 2011-11-22 7 3159 GoldSunMonkey 2011-11-22 21:59
版主帮帮忙：VHDL,verilog混合仿真碰到一个奇怪的现象 attach_img
仿真 ，VHDL ，verilog ，RAM ，FRAM
FPGA论坛 edacsoft 2011-11-11 26 4311 GoldSunMonkey 2011-11-18 11:44
求Verilog黄金参考指南电子文档 attachment
verilog ，电子 ，verilo
FPGA论坛 lxAPP 2011-11-6 10 1899 GoldSunMonkey 2011-11-22 14:28
听说有VHDL和Verilog转换工具，求一个～
verilog ，VHDL ，转换工具
FPGA论坛 星星之火红 2011-11-2 18 2914 ertu 2011-11-4 07:18
请教一下用脉冲前后沿都触发的可综合的Verilog怎么编写
verilog ，编写 ，脉冲 ，触发 ，时钟
FPGA论坛 bucker 2011-10-30 8 2420 XLDZZ 2011-11-22 13:03
Verilog中的行为级，RTL级，门电路级都代表什么意思？
RTL ，verilog ，电路 ，verilo
FPGA论坛 weshiluwei6 2011-10-29 2 3808 weshiluwei6 2011-10-30 09:56
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