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[FPGA] FPGA实际应用案例--通过反推检查代码
2018-8-27 10:06 0 708
[CPLD] 新手入门,请教一个LED的程序 新人帖 attach_img
2018-8-23 15:49 8 1521
有关100M系统时钟下赋值时序出错的问题 新人帖 attach_img
2018-8-23 11:51 0 716
[CPLD] EPM570最小系统构成
2018-8-20 08:25 12 3024
请教一个关于QUARTUS 13.1状态机设置的问题 新人帖 attach_img
2018-8-18 19:57 0 1044
[FPGA] 萌新求助如何FPGA将模拟信号正弦波转换成占空比百分之50的方波
2018-8-17 16:00 5 2331
ZYNQ 7Z020
2018-8-16 20:29 5 2723
[FPGA] 求XC6SLX9参考原理图
2018-8-15 15:15 5 4948
[verilog] signaltap II综合assign语句的问题
2018-8-13 23:22 3 1287
[FPGA] 基于FPGA的信号处理教程
2018-8-13 11:06 0 913
[FPGA] 基于fpga的信号与处理视频
2018-8-9 21:34 0 1197
[verilog] 各位大神有使用verilog实现RS485总线通信或者hub集线器的么,相关的资料也可~ 新人帖
2018-8-9 11:48 4 2686
[verilog] 初学者请大家帮忙看看这段代码到底错在哪儿了?找了一..... 新人帖 attach_img
2018-8-8 16:20 0 981
[CPLD] 有谁有maxv的晶振电路设计方面的资料
2018-8-8 11:45 0 831
[FPGA] 请问Libero怎么安装失败啊 attach_img
2018-8-8 10:04 4 1310
代码功能仿真正确,但在板上不行,是不是时序的问题?
2018-8-7 09:15 4 1685
[verilog] 有偿求帮忙调试一个后仿 新人帖
2018-8-5 21:14 7 1630
[CPLD] 编译警告的问题 attachment
2018-8-4 09:48 1 634
[FPGA] 转FPGA FAE ,请问各位技术面试主要面哪些内容
2018-8-4 08:56 0 1275
[FPGA] 用FPGA能产生1nS脉冲吗? 新人帖
2018-8-3 20:46 9 6552
[FPGA] 现在想要安装ACTEL的libero11.8是不是只能用64位系统了。
2018-8-3 14:38 0 1279
[FPGA] FPGA驱动HT1621的问题 attachment
2018-8-3 08:06 2 1092
FPGA会用到外置SRAM吗?
2018-8-2 22:25 4 1973
[FPGA] 两条DDR2怎样组成32bit数据读写 新人帖
2018-8-1 23:10 0 1185
晒晒双FPGA板 attach_img
2018-8-1 22:29 15 2736
[FPGA] FPGA 新人帖
2018-8-1 10:12 0 602
[FPGA] 如何看懂别人的代码
2018-7-31 10:38 1 825
[FPGA] 参数宏定义不懂 新人帖
2018-7-29 17:34 0 1188
[verilog] 请教一下Verilog数据处理问题
2018-7-28 19:06 1 1348
[verilog] ADC数字校准中,在testbench可以用小数分数的形式用于计算? 新人帖
2018-7-28 08:05 0 1538
[FPGA] 学fpga有出路么? 新人帖
2018-7-27 10:58 15 4132
[verilog] 一个初学者简单的语句 新人帖
2018-7-27 08:44 2 1231
impact烧录cpld程序,勾选read protect和write protect有什么后果? attach_img
2018-7-26 18:27 3 1867
[verilog] 直播写一个RISC-V IMC的CPU attach_img
2018-7-23 14:56 9 9371
求助大神,FFT核输出结果和真实值总是差1 新人帖 attach_img
2018-7-23 13:50 1 1491
[FPGA] 以太网和FPGA之间数据交互 新人帖 attach_img
2018-7-19 23:31 7 2284
[CPLD] 用Quartus软件给EPM7064烧录程序,但 programmer中AUTO检测无法检测到芯片是怎么回事
2018-7-19 14:57 1 2858
[FPGA] xilinx SRIO激活 attach_img
2018-7-19 14:41 3 2509
[FPGA] fpga 时序约束讲解视频 attach_img
2018-7-18 15:34 0 1379
[VHDL] VHDL 结构体中定义的ATTRIBUTE是什么?
2018-7-18 15:33 2 4934
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