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ddr3 读写控制 新人帖
2017-4-19 14:44 0 1129
[FPGA] 求助:多点节通信总线或接口
2017-5-3 11:33 8 1054
为什么quatus 13.0怎么也安装不了?
2017-4-18 09:19 0 656
[FPGA] V7 GTH使用问题 新人帖
2017-4-24 10:06 5 1780
cpld和dsp16位总线相连,24位数据如何传输?
2017-4-17 18:09 2 1074
[FPGA] FPGA基础篇(三):modelsim仿真的几个常见问题 attach_img
2017-4-15 21:48 0 1122
[FPGA] 关于EP4CE15的PLL倍频问题 新人帖
2017-4-15 17:05 0 1547
[FPGA] 求助!使用FPGA做AD采集卡,有个AD模块总是跑飞 新人帖
2017-4-15 16:47 0 799
[FPGA] 串行结构的FIR滤波器设计 (含有代码 文档资料)转
2017-4-21 10:45 4 1135
[FPGA] 【小杨哥FPGA学习教程】 attachment  ...23
2018-11-29 15:32 46 6318
如何用原理图设计方法给各个输入付初值~ attach_img
2017-4-13 18:53 0 748
[Quartus] nois2中预定义组件的HDL代码能否查看?
2017-4-13 12:38 0 949
[FPGA] 88E1111的RX_CLK没有输出的问题
2017-10-14 18:32 8 3965
[FPGA] 不清楚 K4s64163 与 HY571641620 这两款SDRAM的区别
2017-4-12 17:03 0 763
求帮助!!! 新人帖
2017-4-11 10:19 0 470
关于xilinx FPGA的时序仿真问题 attach_img
2017-4-11 09:51 0 711
[FPGA] fpga中如何利用gpio实现复位? 新人帖
2017-4-11 09:44 0 1100
[FPGA] 华为内部资料:FPGA设计高级技巧(altera篇)以及代码书写...
2017-4-10 19:53 0 1140
[FPGA] fpga应用篇(四):binary2bcd attach_img
2017-4-10 18:06 0 670
[FPGA] fpga应用篇(三):你可能用了假分频 attach_img
2017-4-13 11:45 8 1172
[FPGA] fpga应用篇(二):边沿检测 attach_img
2017-5-21 13:16 3 1223
[FPGA] vivado仿真出错 新人帖
2017-4-6 11:47 0 706
[FPGA] can转WIFI适配器电路图 新人帖
2017-4-5 21:27 0 672
[FPGA] fpga基础篇(一):阻塞与非阻塞赋值 attach_img
2017-4-5 09:56 0 898
[FPGA] ISE编译时出错,怎么改都不对,求大神指点 新人帖 attach_img
2017-4-5 16:46 2 783
如何控制时序
2017-4-1 09:43 0 634
[FPGA] 一个合格的FPGA工程师需要掌握哪些知识?
2017-3-31 11:38 0 968
[FPGA] 如何用FPGA实现CAN控制器 新人帖
2017-4-8 10:43 3 2203
[CPLD] 关于CPLD在线调试的问题 新人帖
2017-4-8 10:35 3 1695
[FPGA] 问题求助 新人帖 attach_img
2017-3-28 16:56 0 632
[FPGA] 分享海量FPGA设计技巧学习资料
2017-5-24 11:12 8 1864
[FPGA] 如何减少资源的使用
2017-3-27 16:29 1 1305
[FPGA] 基于至简设计法实现的PWM调制verilog attachment
2017-3-25 23:18 2 656
[FPGA] 求解
2017-3-29 16:43 2 670
[Quartus] 求解!!win10的pin管脚设置打开就崩溃 新人帖
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[FPGA] 经典FPGA毕业设计案例文档教程
2017-3-23 10:23 0 1233
[CPLD] ALTERA CPLD MAX7000S的擦写次数 新人帖
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[verilog] 倒计时系统设计(下)之数码管显示和顶层 attach_img
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[verilog] 倒计时系统设计(中)之BCD编码模块 attach_img
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[verilog] 倒计时系统设计(上)之计时模块 attach_img
2017-3-21 21:26 1 1612
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