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读xilinx zynq-7000 AP SoC上的SRAM
2013-12-18 08:56 2 2131
请教各位高手,FPGA程序组合逻辑门占用资源过多,怎么降低呀,急!!!!!
2013-12-18 16:07 8 2949
[FPGA] IP核通过综合,在映射时被移除,如何解决???
2013-12-17 10:09 1 1879
DDR3 app接口读写数据命令问题
2014-7-13 11:17 1 1498
[FPGA] 京微雅格国产FPGA推荐
2013-12-21 19:38 4 2155
台湾晶振那个品牌比较好呢
2014-11-19 09:28 3 1629
[FPGA] 有做赛灵思的么?请问用IP核做的FIFO复位信号为何不管用? attach_img
2013-12-12 15:56 1 1792
[FPGA] 多个按键同时检测的情况怎么搞? attach_img
2013-12-11 19:07 1 1697
[FPGA] Xilinx All Programmable UltraScale产品系列荣耀面世
2013-12-10 20:29 0 1721
[FPGA] 请教个ise12.4 上用的Rapidio ip核的问题
2013-12-10 19:56 0 1399
[FPGA] FIR 滤波器不同时钟下工作结果怎么不一样
2013-12-25 17:19 11 2209
function函数中是否可以用非阻塞赋值
2013-12-9 17:20 0 1182
[FPGA] altera芯片输出端口多的话就发热大问题
2013-12-9 16:55 0 1465
MII半元组向MAC一个字节转换
2013-12-9 16:15 0 1293
[FPGA] Xilinx All Programmable解决方案亮相2013 SPS/IPC Drives展会
2013-12-9 15:15 0 1661
module 模块是否可以不用clk 触发?
2013-12-10 22:45 4 1896
[modelsim] modelsim 二分频出问题了 attach_img
2013-12-10 10:34 7 1672
[FPGA] 想学FPGA应该用什么软件
2013-12-19 13:59 3 1730
晒晒偶在ARM 技术研讨会上拍摄的XILINX 展台! attach_img
2013-12-8 20:43 0 1323
[FPGA] fpga如何实现浮点指数运算?
2013-12-15 16:10 5 6969
[FPGA] 关于xilinx FPGA Virtex6内RapidIO核的问题
2015-9-22 09:21 2 2504
用vhdl写的i2c无应答 attach_img
2013-12-6 20:32 1 1315
[modelsim] 数据有效的方式
2013-12-7 23:54 2 1711
[FPGA] 现在最便宜的FPGA多少钱?功耗多少?
2013-12-6 18:47 4 4983
怎样学习fpga啊?求带路
2013-12-8 14:18 1 1115
[verilog] 写法不同综合出的结果有什么差异
2014-3-6 18:48 2 1752
请教:我做的三层电梯程序,为什么仿真总得不到我想要的
2013-12-18 18:24 5 1807
请教Quartus II 11.1安装时出现的问题 attach_img
2013-12-4 14:15 0 1340
新手
2013-12-3 21:51 0 995
利用CHIPSCOP进行DDR3控制器内部信号观测的问题
2013-12-4 16:54 1 1532
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