本版专家: gaochy1126
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客户要求用CPLD开发,说是比MCU可靠
2010-1-3 15:12 15 4419
请问EFR,HTOL和Burn in的异同
2010-1-3 12:29 1 5131
不知道该学啥了。。。。
2009-12-31 22:40 6 3823
如何设计最优化的状态机(完整版) attachment digest
2009-12-30 21:08 10 4640
FPGA 如何定义内部信号地址
2009-12-30 10:14 0 2573
谁有EPM240的中文文档啊 顺带问些小问题
2009-12-29 17:07 5 4263
quartusII 9.0可以通过下载电缆读回cpld的bitstream吗?
2009-12-28 23:40 1 3170
求高人帮忙
2009-12-28 15:46 6 3039
面向未来的IC设计方案
2009-12-27 17:39 8 3302
IP源码(verilog,vhdl)大赠送
2009-12-27 16:08 19 4050
辛苦各位仁兄进来干看看,关于18B20测温的研究 attachment
2009-12-26 21:21 2 2692
请教:目前最好的硬件仿真环境是什么?
2009-12-25 15:19 5 3758
关于IC的查询问题
2009-12-25 09:54 0 2258
Verilog读书笔记之二
2009-12-24 15:19 0 2200
ALWAYS模块的敏感量(读书体会,解决以前问题)  ...2
2009-12-24 15:13 34 7927
自己做开发板,学习FPGA,有感兴趣一起玩的吗?
2009-12-24 11:45 3 2941
弱弱的何为dft高手?请高手指点
2009-12-24 09:49 0 2226
撇撇做dft遇到的问题题
2009-12-23 15:30 0 2249
请看看这是什么设备? attach_img
2009-12-23 08:47 5 3122
quaruts报错,求解答
2009-12-23 08:14 7 3407
LATTICE CPLD的问题 attach_img
2009-12-23 08:10 1 3302
VHDL写的光电编码器程序 逻辑单元居然是0
2009-12-22 13:35 2 4057
proteus中如何计算静态工作点?
2009-12-22 11:12 0 3083
RAM 核时序!
2009-12-21 17:25 6 2618
基于FPGA的跨时钟域信号处理——MCU attach_img
2009-12-19 15:16 3 3617
基于FPGA的跨时钟域信号处理——同步设计的重要 attach_img
2009-12-19 15:13 0 2879
ISE9.1I新建IP core attach_img
2009-12-18 11:58 1 2389
lattice cpld 上电时候的输入状态
2009-12-17 22:59 1 4373
FSM中组合进程CASE语句问题
2009-12-17 20:46 1 2347
基于Xilinx ISE的仿真
2009-12-16 19:44 0 3111
低价提供闲置元器件,附清单
2009-12-16 14:36 0 1872
Xilinx CPLD/FPGA开发环境搭建(Synplify Pro 9.6.2 安装与**)
2009-12-14 18:47 0 6851
燃气灶脉冲点火电路
2009-12-14 17:29 0 3607
大家来讨论下怎么在DE2板上与电脑实现I2C
2009-12-14 14:39 0 2327
请问有带摄像头控制的开发板吗?
2009-12-14 11:47 2 2676
关于for。。。generate的疑问
2009-12-13 13:16 0 2580
求助 单片机与FPGA的连接问题
2009-12-12 18:55 6 3107
请教,floorplan工具干嘛用的?SDF规范是什么?谢谢!
2009-12-12 15:57 0 2290
FPGA前辈请进! 帮帮我这个菜鸟!  ...2
2009-12-10 13:53 20 5001
求职!! attachment
2009-12-8 15:28 6 3002
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