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[modelsim] 关于 EDA RTL simulation 的问题
2014-2-18 22:23 2 2089
[FPGA] 这是软件版本的问题吗? attach_img
2013-11-26 22:15 3 1574
差分时钟如何引入FPGA
2013-11-17 11:02 4 2019
[FPGA] 或许自己没有竞争力,fpga的工作真难找!  ...2
2013-12-6 22:47 23 4610
求助,信号噪声
2013-11-11 10:56 1 1257
A3P060做两个16位的乘法都做不了吗
2013-11-10 17:07 1 1307
[FPGA] 有熟悉Altera的进来指点下 attach_img
2013-11-10 20:18 2 1531
请教 xilinx的时序报告中的这段话是什么意思 attach_img
2013-11-13 21:20 5 1629
[FPGA] 去掉chipscope
2013-11-8 11:25 0 1177
[FPGA] MIG生成的DDR2_SDRAM该怎么用 attach_img
2014-1-12 23:42 8 2635
[FPGA] rom IP核的仿真问题
2013-11-6 11:09 5 1730
[FPGA] 呼叫猴哥,关于V5系列GTP的用法
2013-12-25 22:09 4 2413
FPGA中两个模块间怎么传输大数据
2013-11-5 07:57 2 1862
FIR滤波器的输出是输入延迟N个周期才输出吗? 如何得知啊?
2013-11-1 21:02 0 1593
CPLD相邻引脚干扰问题
2013-11-6 15:25 6 1786
[FPGA] FPGA的DDR模块接口连接DDR3时需要上拉电阻吗?
2013-11-8 17:27 6 5216
[FPGA] FPGA招聘都是本科,我又不是,我该投简历吗?各位给点建议
2013-12-3 17:39 11 2577
[verilog] 在读写ddr2的时候,DQS信号怎么用,可不可以不用
2014-9-18 23:03 4 2547
[FPGA] 问个基本问题
2013-10-30 21:08 1 1438
来求助了,quartus怎么生成不了可编程的文件啊????
2013-11-28 10:05 3 1894
[FPGA] CYCLONE IV EP4CE15F17C8N的JTAG
2013-11-1 01:27 3 2634
[modelsim] 求助
2013-10-28 23:12 0 1178
读flash不好使
2013-11-1 10:41 4 2293
求解惑。
2013-10-26 13:28 6 1034
[FPGA] [Spartan-6]FPGA上电配置过程中的IO电平问题
2013-10-26 17:40 4 4475
FPGA速度等级问题
2013-10-25 23:12 7 3027
[FPGA] ISE14.3是否不完全支持K7芯片的某些bank区的电平设置
2013-10-26 08:39 2 3365
[FPGA] 如何通过DDR3控制器将DDR3应用到具体的工程里面
2013-10-28 18:43 6 1997
[FPGA] 关于xcf32p配置电路的一个问题 attach_img
2015-4-16 21:12 8 2681
[FPGA] 如何编写约束文件? attachment
2016-1-13 23:56 17 4359
[FPGA] FPGA开发板咨询
2014-1-8 09:55 5 1622
[FPGA] 有关AD9914手册中的DAC校准
2013-11-7 00:08 5 2758
[FPGA] 关于计数器
2013-10-23 09:02 6 1371
帮忙看一下,这个ip核是不是可以用来生成bit? attach_img
2013-10-22 00:05 3 1225
[verilog] Verilog 2001相关
2013-10-18 16:44 0 1451
FIR 数字滤波器的系数(coefficient)和阶数(order)是一个吗?
2013-10-21 20:35 5 5024
[FPGA] LTC1446这款DA有人用过么?
2013-10-22 21:25 2 1571
求教编写仿真测试程序的思路
2013-10-21 23:16 2 1067
spartan-6 dcm_clkgen使用问题
2013-10-23 14:07 11 3815
FPGA总是配置不成功
2013-10-16 17:40 2 1157
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