今日: 3|主题: 14232|帖子: 104438 收藏 (180)
用FPGA做采样率为10MSPS的板子,两层板可以搞定吗?
2012-7-15 17:36 6 1912
求基于FPGA的(DDS)任意信号发生器????
2013-8-20 08:10 3 1985
有没有从orcad原理图自动提取UCF文件的软件?
2012-7-17 13:13 10 3699
求了解MicroBlaze的性能
2012-7-12 21:29 5 1805
[VHDL] BRAM资源占用问题
2012-7-12 19:52 4 2890
请求帮忙设计一个声纳系统的信号采集部分。。。。
2022-3-24 11:06 11 3369
请问大家了解coreconsultant吗
2012-12-18 22:55 6 6420
[matlab] 我的ISE开始菜单中缺少很多工具
2012-12-25 21:08 15 2089
那有谁知道CCITT-CRC16的反转算法,串行的电路是怎样的?
2012-7-10 22:07 2 2043
请问fpga设计的串口一定时间后输出全是0的原因
2012-7-16 21:01 9 2192
蜻蜓点水之Picroblaze attach_img digest
2012-7-13 14:24 10 3363
再次请教fifo的问题
2012-7-11 00:17 11 2215
[modelsim] 问一个chipscope的问题
2014-1-22 16:48 15 8229
有谁用WINCUPL?刚学,请教如何生成JED
2012-7-10 22:08 2 2644
那有谁知道CCITT-CRC16的反转算法,串行的电路是怎样的?
2012-7-9 14:47 2 1841
基于FPGA的数字滤波系统设计 attachment
2012-7-10 18:32 2 1417
active和modelsim
2012-7-6 21:45 4 1777
能否用FPGA/CPLD输出SPWM波?
2012-7-5 09:14 0 1777
[matlab] 13.4版本 EDK中下载遇到Data2MEM的问题 attachment
2012-7-4 13:33 6 2825
进位链 attachment
2013-3-10 19:43 18 3729
verilog语言实现crc16的串行和并行算法
2012-8-13 22:27 19 15979
赛灵思推出业界领先的 PCI 3.0硬模块和1866 Mb/s DDR3 解决方案
2012-7-30 14:33 5 2101
实现350ps左右的延迟
2012-7-4 21:52 8 2025
X-fest 2012 亚洲巡回即将开始
2012-7-4 14:41 17 6963
延迟问题
2012-7-2 12:08 2 1750
一个关于延迟检测的问题  ...2
2012-7-6 22:35 28 4380
关于信号延迟问题 attach_img
2012-7-9 22:12 6 2504
如何用verilog语言实现crc16的串行和并行算法
2012-6-28 15:00 0 3076
Xilinx中是否有类似altera中lpm_constant的IP核吗?
2012-7-2 16:48 16 6054
chipscope仿真的结果
2012-6-28 22:42 4 2100
[matlab] ISE综合问题
2012-6-28 20:27 8 2363
LVDS 33 LVDS 25 LVDS 18到底能不能直连
2019-3-12 23:47 10 26484
求推荐xilinx学习的书籍
2012-6-28 12:29 2 1763
求推荐一个FPGA型号
2012-7-31 17:31 12 2840
[CPLD] 有谁用过XILINX FIFO IP核啊!  ...2
2012-7-17 21:57 20 10177
Xilinx Workshop邀请函 attachment
2012-6-27 16:47 5 1893
[VHDL] 关于布局时出现的一个警告  ...2
2013-11-9 12:37 31 5117
关于ISE综合一个warning的疑问,交流帖
2015-1-19 10:24 19 10629
有没有开源的SPI核啊? attachment
2012-6-25 18:57 4 1886
FPGA中IP核的生成(回复给分) attach_img  ...2
2012-12-2 22:05 28 3917
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