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[Quartus] 求购xilinx SP605开发板
2012-5-27 12:22 2 2144
哪能买到spartan的核心板,非开发板
2012-5-26 21:46 1 1267
[VHDL] chipscope使用问题
2012-5-26 18:47 8 1812
后仿真一个奇怪的问题 attach_img  ...2
2012-5-26 18:14 25 3208
面向动态应用的灵活操作系统
2012-5-26 18:12 3 1387
FPGA在高速互连中的应用
2012-5-26 18:10 4 1746
VGA接口设计原理 attachment
2012-5-26 17:07 2 1499
VGA接口设计原理 attachment agree
2012-5-26 17:03 1 1314
想学习串口通讯,哪位有参考代码供学习吗? attach_img  ...23
2012-5-26 10:13 43 5529
基于赛灵思spartan-3E的安全通信系统的实现
2012-5-25 16:58 1 1348
FPGA编程语言的设计 attachment
2012-5-25 16:35 3 1675
采用FPGA实现视频应用中的OSD设计
2012-5-25 15:53 2 1483
SiTime的可编程MEMS振荡器为赛灵思7系列评估套件提供参考时钟
2012-5-25 12:45 0 1588
北京博电借助Xilinx FPGA交付最新系列智能电网测试设备
2012-5-25 12:42 0 1362
基于ARM+FPGA的重构控制器设计
2012-5-25 12:00 0 1873
基于DSP和赛灵思Spartan-6的SDR系统实现
2012-5-25 11:45 0 1497
modelsim里如何添加信号 attach_img
2012-5-25 08:49 3 3569
quartus里软件仿真的数据能提取出来吗
2012-5-24 23:13 0 1177
时序违规的问题
2012-5-24 16:45 9 2104
CPLD的内部RAM怎样用呀?高人. attachment
2012-5-24 14:45 11 3217
[Quartus] 关于DDR2时序的问题,请高手帮帮忙 attach_img
2012-5-24 14:11 6 2392
HDB3 verilog
2012-5-24 10:48 0 1601
最活跃FPGA论坛推荐  ...2
2012-5-23 20:55 21 4095
一种基于DDS技术的通信信号的调制方法与设计 attachment
2012-5-23 20:53 2 1379
vldh教程分享一下 attachment
2012-5-23 20:39 3 4926
请教一个V6器件访问DDR2的问题
2012-5-23 20:39 2 1718
FPGA设计提速的几大 法宝
2012-5-23 20:28 13 2719
基于赛灵思spartan-3 的DSP嵌入系统及其在平板显示器中的应用
2012-5-23 20:25 12 2270
关于PROM的使用
2012-5-23 09:58 2 1130
项目前期怎么确定FPGA/CPLD芯片容量?
2012-5-23 00:20 5 2726
招聘:赛灵思两个职位空缺-北上广任你选
2012-5-22 17:31 9 2741
xilinx教程学习 attachment
2012-5-22 17:25 1 904
[matlab] xilinx的ISE下载
2012-5-22 17:22 14 3760
VHDL+Verilog良好的代码编写风格(二十五条)
2012-5-22 17:16 13 2660
信号完整性和时序分析的模式变化 attachment
2012-5-22 15:55 2 1587
直接从C代码自动寻找和创建加速器 attachment
2012-5-22 15:54 2 1604
FPGA菜鸟入门前的准备  ...2
2012-5-22 15:50 21 3120
Verilog代码覆盖率检查
2012-5-22 13:07 6 1753
Vivado的出来了,我还是会想念ise的
2012-5-22 12:31 13 3824
最最最最---简单--简单的状态机
2012-5-22 10:36 1 1184
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