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[matlab] 下载Microblaze程序到Flash
2020-1-5 19:33 10 4645
[FPGA] 玩转Zynq连载25——[ex04] 基于Zynq PL的自定义IP核集成 attach_img
2020-1-3 10:02 0 691
[FPGA] 我的 VGA 模块来了,含视频教程。大家看看 attach_img  ...2345
2020-1-2 23:03 93 14463
[verilog] FPGA上GTX光纤传输 新人帖
2020-1-2 20:39 3 2127
[FPGA] 玩转Zynq连载24——用户自定义IP核的移植 attach_img
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[FPGA] MIPI DPHY接口的若干种实现方案概述 attach_img
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[FPGA] 玩转Zynq连载23——用户自定义IP核的创建与封装 attach_img
2019-12-31 10:25 0 810
[FPGA] 玩转Zynq连载22——[ex03] 基于Zynq PL的PLL配置实例 attach_img
2019-12-30 10:37 0 1024
FPGA入门视频 新人帖 attach_img  ...23
2019-12-29 22:25 52 6693
[matlab] ICON/ILA/VIO核的例化 attachment
2019-12-28 14:18 13 10599
求助!调试FPGA时如何把时钟改成JTAG CLK
2019-12-27 15:33 1 2713
[FPGA] 玩转Zynq连载21——Vivado中IP核的移植 attach_img
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[FPGA] 玩转Zynq连载20——基于FPGA的模块化设计 attach_img
2019-12-26 21:01 1 1020
[FPGA] ERROR PACK:198的问题
2019-12-26 15:55 7 4054
[FPGA] 玩转Zynq连载18——[ex01] 小试牛刀,基于Zynq PL的第一个工程 attach_img
2019-12-25 21:47 1 890
[verilog] 组合逻辑与时序逻辑为什么要分开写
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[FPGA] SPARTAN 6 配置SPI FLASH失败 新人帖 attach_img
2019-12-24 15:59 8 6449
[FPGA] FPGA仿真好麻烦啊,不想仿真可以吗
2019-12-24 15:46 10 1728
[FPGA] 请教各位SPARTAN6的SILICE内部每个Fliip-flop如何实现级联
2019-12-24 11:41 0 638
[FPGA] 玩转Zynq连载19——[ex02]基于Zynq PL的欢快流水灯 attach_img
2019-12-24 11:03 0 695
A7配置SPI FLASH失败 新人帖
2019-12-24 08:08 6 2412
ALTERA浮点IP核的问题
2019-12-23 14:29 0 753
[matlab] 谁推荐个microblaze的书?(from smth)
2019-12-23 11:04 7 5420
[FPGA] 有关Quartus II 13.0软件的一个问题 新人帖 attach_img
2019-12-21 16:22 0 468
玩转Zynq连载17——新建Vivado工程 attach_img
2019-12-20 10:49 0 924
FPGA设计经典书籍-资料汇总下载 attachment agree  ...23456..13
2019-12-20 10:03 257 48242
[FPGA] 玩转Zynq连载16——Ubuntu16.04 64bit安装 attach_img
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[FPGA] 玩转Zynq连载15——使用GIT进行工程备份和版本管理7 attach_img
2019-12-18 22:10 0 943
[VHDL] xc5vfx30t多少钱了?民工能用起了吗?  ...2
2019-12-18 16:34 24 5844
XC5VLX155 怎么要1万每片,不敢选了。。。  ...2
2019-12-18 15:51 23 4946
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