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[FPGA] fpga输入和输出连接会有影响吗?
2013-10-17 15:25 2 1621
有谁做过赛灵思k7的Slave Serial Configuration的配置模式么?
2013-10-17 13:54 0 1406
[VHDL] 求助:关于modelsim下仿真出错 attach_img
2013-10-17 08:48 2 1619
[VHDL] 求助:结构体中使用signal和variable最后综合有什么区别呢
2013-11-8 21:39 2 2079
[modelsim] 求助:modelsim中如何对VHDL仿真
2013-10-17 15:28 7 2165
promgen.exe这个有谁有么
2013-10-15 17:26 0 1640
marvell 88SE92xx SATA 6Gb/s Host Controllers
2013-10-15 15:29 0 1892
[FPGA] FGPA DVI TFP401A
2018-1-27 08:47 3 2377
有没有有关FPGA的群啊。。。?
2013-10-17 15:19 2 1248
FPGA实现的SPI转多通道UART、485 attachment
2013-10-14 09:54 3 1744
CYCLONEIII的DDR2核需要LICENSE?
2013-10-13 18:04 3 1625
cyclone iv h264解决方案方案
2013-10-12 21:08 1 1524
[FPGA] Node<a> of sequential type is unconnected in blockA
2013-10-11 22:35 3 3483
[FPGA] FPGA控制AD采样数据DDR3存储后出现毛刺的问题
2013-10-12 16:09 8 4580
[verilog] 代码分析
2013-10-23 14:32 10 2114
[FPGA] 关于用的FPGA做位同步时钟提取问题,求大神进来指导!
2013-10-15 16:12 10 2026
[Quartus] Quartusii12.1调用ModelSim-Altera
2014-3-17 14:47 5 2032
[modelsim] 哪位大神有最新版的modelsim软件?
2013-10-10 14:20 5 1584
[FPGA] FPGA和FT245之间的传输速率是多少
2013-10-5 23:36 0 1684
[verilog] 自定义ram问题
2014-9-12 11:24 5 3970
[FPGA] fpga 硬件设计
2013-10-2 17:41 2 1481
ddr2 ram读写地址的困惑,求助。。。。。 attach_img
2013-10-15 19:21 6 2187
DDR2的锁相环与网表
2013-10-5 16:39 3 1495
[FPGA] 问一个有关RapidIO地址映射的问题
2013-10-8 23:11 2 1619
quartusii不能选器件 attach_img
2013-9-27 23:23 2 2183
[FPGA] xilinx floating_point这个核
2013-9-26 19:09 1 1344
[FPGA] xilinx的DDS core可以设定幅度吗?
2013-10-14 22:41 1 1323
nandflash 坏块检测
2014-3-18 10:02 4 1313
[modelsim] Modelsim 中do 文件编写怎么调不出内部波形 attach_img
2013-9-26 17:37 2 2022
请版主或高手推荐一款FPGA。
2013-10-6 17:15 5 1690
[FPGA] 探讨几个基本的问题
2013-10-13 19:40 13 1988
[FPGA] XILINX 的 ISE ,怎么在原理图里将输入和输出直接连接起来? attach_img
2013-9-25 18:53 4 4880
HD video完全相容于ALTERA Cyclone 3 的开发环境
2013-9-24 10:37 0 1283
[FPGA] 高清Full HD FIFO DRAM的工作原理介绍
2013-9-24 10:35 0 1576
[FPGA] 技术资料
2013-9-23 12:46 0 1310
[FPGA] 有多项式可以用来逼近lgx吗?以十为底。
2013-9-24 16:03 4 1487
XILINX的AXI DATAMOVER IP CORE的问题
2013-9-23 22:09 2 6947
[FPGA] 求助,用MIG生成ddr2控制器,运行example design 提示出错
2015-12-18 14:22 14 4507
[verilog] FFT核做8192点数据,但是仿真结果和matlab的结果不一致,怎么办?求高手帮忙
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[FPGA] 我想计算一个多项式(xilinx verilog)
2013-9-23 23:53 7 2037
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