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[FPGA] 有熟悉Altera的进来指点下 attach_img
2013-11-10 20:18 2 1618
[FPGA] syplify综合
2013-11-10 17:38 1 1299
A3P060做两个16位的乘法都做不了吗
2013-11-10 17:07 1 1380
一个Verilog新手问题 attach_img
2013-11-10 16:13 7 1607
[CPLD] xilinx的千兆以太网IP核是免费的吗?  ...2
2013-11-9 13:21 28 14057
[VHDL] 关于布局时出现的一个警告  ...2
2013-11-9 12:37 31 5515
[VHDL] 菜鸟就是菜鸟,连ISE测试文件都没搞好 attach_img  ...2
2013-11-8 21:58 21 4754
[VHDL] cpld写lcd的时序,第一次写vhdl,大家帮忙看看有问题没 attach_img
2013-11-8 21:50 6 2044
[VHDL] 求助:结构体中使用signal和variable最后综合有什么区别呢
2013-11-8 21:39 2 2180
[FPGA] 存储问题
2013-11-8 21:14 10 1950
[FPGA] 延时
2013-11-8 21:10 5 2426
一个牛人对FPGA的理解--太可怕了!  ...2
2013-11-8 20:32 30 9885
用ISE自带仿真软件对于fpga代码数据仿真问题
2013-11-8 17:55 1 1801
[FPGA] FPGA的DDR模块接口连接DDR3时需要上拉电阻吗?
2013-11-8 17:27 6 5418
[FPGA] 去掉chipscope
2013-11-8 11:25 0 1241
Monkey版,咨询以下SRIO的授权问题
2013-11-8 11:23 17 4709
《基于VHDL的FPGA与NIOS_II实例精炼》配套源代码与视频整理
2013-11-8 08:35 6 4197
[FPGA] FPGA嵌入NIOSii后flash数量问题
2013-11-7 22:15 0 1652
[FPGA] 如何在XST下使用synplif综合得到的网表文件?
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用DDR3的mig仿真问题
2013-11-7 17:54 2 2108
[FPGA] 适合fpga初学者的书籍
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[FPGA] 有关AD9914手册中的DAC校准
2013-11-7 00:08 5 2960
CPLD相邻引脚干扰问题
2013-11-6 15:25 6 1933
modelsim
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贴片知识:元件PCB封装
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[FPGA] rom IP核的仿真问题
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PCIE ip core 中断问题
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DCM问题
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[FPGA] FPGA控制SDRAM 8寸LCD显示缓存 交流
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FPGA中两个模块间怎么传输大数据
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GTX 问题 求救
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[FPGA] Quartus9.0调用modesim6.4仿真出现以下现象,怎么回事 attach_img
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[VHDL] 【求助】一个ppm编码器,老是仿真不对 attach_img
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