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今日: 0|主题: 14363|帖子: 104828

Xilinx DSP Primer中文手册 attachment
2013-12-3 22:55 11 3814
请高手来解答,跪求啊
2013-12-3 22:35 3 2151
FPGA中,怎麼計算用了多少個LE呢?
2013-12-3 22:14 1 1346
新手
2013-12-3 21:51 0 992
[FPGA] 求问
2013-12-3 19:47 3 1326
[FPGA] FPGA招聘都是本科,我又不是,我该投简历吗?各位给点建议
2013-12-3 17:39 11 2933
关于verilog实现CRC的问题 attach_img
2013-12-3 17:30 11 2664
[FPGA] 请教一个FPGA时序仿真的问题
2013-12-3 13:21 1 1505
RFID枪支管理双重保障方案
2013-12-3 10:12 0 1750
辽宁省将采用RFID身份标签对宠物进行管理!
2013-12-3 10:12 0 1647
北京交管局正在研究试行RFID电子车牌
2013-12-3 10:11 0 1498
安庆海事局采用RFID技术进行船舶管理
2013-12-3 10:10 0 1521
郑州航空港经济综合实验区RFID技术研发基地项目正式启动!
2013-12-3 10:09 0 1438
[FPGA] FPGA之间的通信问题
2013-12-3 09:55 13 2688
[CPLD] 利用cpld扩展ARM的I/o口
2013-12-3 09:53 3 2013
[FPGA] ddr3 的app 接口仿真问题
2013-12-3 08:30 5 2225
[VHDL] 用conv_integer转换后位宽的问题
2013-12-2 16:48 2 3487
[FPGA] 请问设计这样一个比较器需要耗费多少个逻辑单元 attach_img
2013-12-2 13:47 1 1297
[FPGA] SPARTAN-6 MCB关于同步的问题  ...2
2013-12-2 10:17 30 3844
[FPGA] M9K的使用问题
2013-12-1 21:44 1 1909
在quartus的qsf文件里如何将两个双向口连起来
2013-12-1 21:35 1 1740
[Quartus] nios的引脚分配问题 attach_img
2013-12-1 10:56 0 1644
[verilog] 请教一个问题
2013-11-28 13:10 11 1774
来求助了,quartus怎么生成不了可编程的文件啊????
2013-11-28 10:05 3 2090
基于FPGA的高速数据采集控制模块设计
2013-11-27 21:11 1 2333
[verilog] 一个时钟下降沿计数,经常检测不到下降沿 attach_img
2013-11-27 15:42 9 2415
[FPGA] 关于isop补偿滤波器的系统函数表达
2013-11-27 15:22 9 3221
[FPGA] ise 布局布线不通过
2013-11-27 14:59 7 3356
[FPGA] PCI9054
2013-11-27 11:43 3 2066
[FPGA] 关于JTAG下载时出现的问题
2013-11-26 22:40 0 1142
[FPGA] 这是软件版本的问题吗? attach_img
2013-11-26 22:15 3 1715
[FPGA] quaartus中调用modelsim遇到了一些问题,求助 attach_img
2013-11-26 14:56 3 1699
simple Dual-port RAM使用问题
2013-11-25 23:25 1 2414
VHDL有符号数的表示
2013-11-25 20:19 0 1904
char *s=(void *)(onchip_memory_base+256)是什么意思
2013-11-25 17:24 0 1298
FPGA项目外包,高手请进  ...2
2013-11-25 16:21 22 4549
如何正确使用FPGA的时钟资源 attach_img agree  ...2
2013-11-25 16:18 24 4119
chipscope 能显示连续变化的波形么?  ...2
2013-11-25 10:21 26 9136
请问RW485SIAMOND协议是什么协议啊
2013-11-25 08:57 0 1101
[FPGA] 有人愿意赚钱写个USB上位机程序么?
2013-11-24 22:09 12 2496
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