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FPGA精华资料下载
2013-11-12 16:04 12 4537
[FPGA] 综合后FPGA占用DSP48资源较实际的要多
2013-11-11 20:31 0 1580
FPGA常数表是存在哪里呢
2013-11-11 19:45 3 1934
在FPGA上如何实现排序算法
2013-11-11 16:54 1 1936
[FPGA] chipscope只能显示标号?
2013-11-11 11:35 10 2160
求助,信号噪声
2013-11-11 10:56 1 1400
[FPGA] 有熟悉Altera的进来指点下 attach_img
2013-11-10 20:18 2 1667
[FPGA] syplify综合
2013-11-10 17:38 1 1366
A3P060做两个16位的乘法都做不了吗
2013-11-10 17:07 1 1438
一个Verilog新手问题 attach_img
2013-11-10 16:13 7 1700
[CPLD] xilinx的千兆以太网IP核是免费的吗?  ...2
2013-11-9 13:21 28 14446
[VHDL] 关于布局时出现的一个警告  ...2
2013-11-9 12:37 31 5881
[VHDL] 菜鸟就是菜鸟,连ISE测试文件都没搞好 attach_img  ...2
2013-11-8 21:58 21 4965
[VHDL] cpld写lcd的时序,第一次写vhdl,大家帮忙看看有问题没 attach_img
2013-11-8 21:50 6 2163
[VHDL] 求助:结构体中使用signal和variable最后综合有什么区别呢
2013-11-8 21:39 2 2284
[FPGA] 存储问题
2013-11-8 21:14 10 2068
[FPGA] 延时
2013-11-8 21:10 5 2550
一个牛人对FPGA的理解--太可怕了!  ...2
2013-11-8 20:32 30 10327
用ISE自带仿真软件对于fpga代码数据仿真问题
2013-11-8 17:55 1 1873
[FPGA] FPGA的DDR模块接口连接DDR3时需要上拉电阻吗?
2013-11-8 17:27 6 5611
[FPGA] 去掉chipscope
2013-11-8 11:25 0 1294
Monkey版,咨询以下SRIO的授权问题
2013-11-8 11:23 17 4875
《基于VHDL的FPGA与NIOS_II实例精炼》配套源代码与视频整理
2013-11-8 08:35 6 4298
[FPGA] FPGA嵌入NIOSii后flash数量问题
2013-11-7 22:15 0 1732
[FPGA] 如何在XST下使用synplif综合得到的网表文件?
2013-11-7 17:56 0 1464
用DDR3的mig仿真问题
2013-11-7 17:54 2 2192
[FPGA] 适合fpga初学者的书籍
2013-11-7 08:11 3 1732
[FPGA] 有关AD9914手册中的DAC校准
2013-11-7 00:08 5 3056
CPLD相邻引脚干扰问题
2013-11-6 15:25 6 2001
modelsim
2013-11-6 13:11 0 1218
贴片知识:元件PCB封装
2013-11-6 12:29 3 5667
[FPGA] rom IP核的仿真问题
2013-11-6 11:09 5 1961
PCIE ip core 中断问题
2013-11-6 11:00 0 1472
DCM问题
2013-11-5 22:47 0 1135
[FPGA] FPGA控制SDRAM 8寸LCD显示缓存 交流
2013-11-5 09:40 0 1820
FPGA中两个模块间怎么传输大数据
2013-11-5 07:57 2 2083
GTX 问题 求救
2013-11-5 07:13 2 1345
[FPGA] Quartus9.0调用modesim6.4仿真出现以下现象,怎么回事 attach_img
2013-11-4 19:26 1 1737
[CPLD] 求XC9500XL系列开发板原理图
2013-11-4 16:25 3 2599
[FPGA] SDH的指针下泄
2013-11-4 13:32 1 1186
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