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显示控制控制 XILINX hjjnet 2011-5-3 21:28 5 2163
[CPLD] 求教高人，解答关于管脚约束时钟Pin的错误！！！！时钟管脚 pi mhanchen 2011-5-3 21:28 5 2815
如何通过改善Verilog程序以减少CPLD的宏单元用量 PLD verilog ino1988 2011-5-3 17:09 7 5010
FPGA时序收敛设计技巧 FPGA 时序收敛 COM mzhang198 2011-5-3 09:43 3 2340
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浅说FPGA我自己理解中的硬件描述编程 FPGA 编程硬件 xiaoyuan_ly 2011-4-30 13:56 10 3322
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菜鸟求助：逻辑与和按位与的区别 zgm1193 2011-4-28 22:33 2 2566
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