EDA 技术

今日: 0|主题: 7815|帖子: 43801

1 ... 3 4 5 6 789 10 11 12 ... 196 / 196 页下一页

新窗全部主题最新精华有附件最多回复最多查看零回复更多 \| 显示置顶


[Verilog HDL] verilog基础——always、initial RS ST verilo gaochy1126 2023-11-30 20:54 0 11278
[protel] Verilog中的运算符 verilo verilog 运算符 gaochy1126 2023-11-30 20:52 0 11407
[Verilog HDL] Verilog中“=”和“<=”的区别 gaochy1126 2023-11-30 20:52 0 11604
[Verilog HDL] 一文带你了解verilog基础语法 verilo verilog gaochy1126 2023-11-30 20:51 0 11708
[Verilog HDL] Verilog HDL中位运算符、逻辑运算符和缩减运算符的区别 HDL hd verilo gaochy1126 2023-11-30 20:50 0 12048
[Verilog HDL] verilog 中！与 ~ 的区别 verilo verilog gaochy1126 2023-11-30 20:49 0 11508
[protel] Altium Designer 19使用问题之十三 Designe TI des QWE4562009 2023-10-13 14:32 0 12525
[protel] Altium Designer 铺铜设置要怎么设置才能使得边边角角更圆滑就是钝角一样不尖锐灌铜... Altium Design Designe QWE4562009 2023-10-11 18:21 0 12623
[Verilog HDL] VCS 仿真报错，请大佬帮忙看看 ov nova AC 装逼大师 2023-10-5 23:07 0 12754
[Verilog HDL] Verilog几个这样的写法 verilo verilog gaochy1126 2023-8-31 23:01 1 12328
[Verilog HDL] verilog中符号位的扩展问题 verilo verilog gaochy1126 2023-8-31 22:24 0 12527
[Verilog HDL] verilog，有符号数的运算 verilo verilog gaochy1126 2023-8-31 22:23 0 12750
[Verilog HDL] verilog的结构化、数据流、行为级描述方式 verilo verilog 数据流 gaochy1126 2023-8-31 22:23 0 12688
[Verilog HDL] verilog中的基本数据类型端口 verilo verilog gaochy1126 2023-8-31 22:22 0 12394
[Verilog HDL] Verilog 模块例化 verilo verilog gaochy1126 2023-8-31 22:22 0 12411
[PADS] PADS和AD 哪个好用啊？ ...2 ADS pad pads xiaozhuzhudxb 2023-7-31 21:39 30 27190
[Verilog HDL] 简单测试文件编写编写 gaochy1126 2023-7-28 18:07 1 12164
[Verilog HDL] 测试文件 gaochy1126 2023-7-28 18:05 1 12145
[Verilog HDL] 有限状态机（FSM）有限状态机 gaochy1126 2023-7-28 18:04 1 12404
[Verilog HDL] 异步复位电路复位电路异步 gaochy1126 2023-7-28 18:03 1 11844
[FPGA] D触发器 D触发器触发触发器 gaochy1126 2023-7-28 18:02 1 11207
[Verilog HDL] 两路选择器 gaochy1126 2023-7-28 18:00 1 10922
[Verilog HDL] 全加器 gaochy1126 2023-7-28 17:58 1 10815
[Verilog HDL] 多bit逻辑门 gaochy1126 2023-7-28 17:57 1 10682
[Verilog HDL] 简单组合逻辑电路电路组合逻辑电路逻辑电路 gaochy1126 2023-7-28 17:55 0 10915
[FPGA] Testbench的编写与应用 ST TE TEST gaochy1126 2023-7-28 17:54 2 11209
Altium Designer 怎样添加多个元器件型号？ sdwys 2023-7-27 09:52 1 11182
[protel] Altium Designer 原理图和PCB ECO 设置、电气规则检查、以及规则DRC错误排查？ Altium Design Designe QWE4562009 2023-7-21 16:30 0 10688
Altium Designer PG画铜皮 Altium Design Designe QWE4562009 2023-7-21 16:09 0 10533
[protel] ALTIUM DESIGNER原理图转ORCAD原理图 AD Altium CAD gaochy1126 2023-5-29 17:08 24 11855
[Verilog HDL] VERILOG语法之GENERATE Gen TE ge gaochy1126 2023-5-29 17:04 24 11363
[Verilog HDL] VERILOG实现串口传输UART UART verilo verilog gaochy1126 2023-5-29 17:02 32 11448
[Verilog HDL] VERILOG常见的误区 verilo verilog gaochy1126 2023-5-29 16:58 30 11851
[protel] 板框的定义 Design designer ig gaochy1126 2023-5-29 16:17 0 11711
[Verilog HDL] VERILOG重点解析 verilo verilog gaochy1126 2023-5-29 16:13 0 11017
[Verilog HDL] ALWAYS语句电路 verilog verilo gaochy1126 2023-5-29 16:12 0 10182
[Verilog HDL] INOUT的使用 inout gaochy1126 2023-5-29 16:11 0 10581
[Verilog HDL] 编程规范——RESET Reset se 编程 gaochy1126 2023-5-29 16:10 0 10341
[Verilog HDL] FUNCTION —— VERILOG的函数 IO TI function gaochy1126 2023-5-29 16:09 0 10533
[Verilog HDL] 按键消抖边缘检测如图抖动 gaochy1126 2023-5-29 15:10 2 10476

1 ... 3 4 5 6 789 10 11 12 ... 196 / 196 页下一页

今日: 0|主题: 7815|帖子: 43801

快速发帖