EDA 技术

今日: 0|主题: 7675|帖子: 42749 收藏 (43)

新窗全部主题最新精华有附件最多回复最多查看零回复更多 \| 显示置顶


Altium designer快速入门 Altium Design Designe gaochy1126 2023-3-14 15:55 5 8303
[protel] Altium Designer快捷键 Altium Design Designe gaochy1126 2023-3-14 15:45 1 7153
[protel] Altium Designer常用快捷键 Altium Design Designe gaochy1126 2023-3-14 15:43 0 7166
[protel] 如何把立创EDA上导出的原理图和封装导入AD的元件库 AD EDA 元件 gaochy1126 2023-3-14 15:28 0 8073
[protel] Altium Designer 下载及安装 Altium Design Designe gaochy1126 2023-3-14 15:11 1 7065
[protel] Altium Designer官方超酷pcb布线视频下载（共六集） ...2 3 4 5 6..27 Altium designer pcb布线 forgot 2023-3-10 11:15 524 125168 1
丝印转pdf，怎么让要显示的丝印图铺满整个纸张 pd niu3jin 2023-3-9 17:08 11 5682
[protel] PADS元件外框丝印元件 pads Bottom qiseqiu 2023-3-9 16:53 4 6238
[protel] Altium09的PCB界面中选中元器件时怎么选不中丝印标号了？ Altium PCB 元器件 xiaobinshenzhen 2023-3-9 16:50 8 8981
[protel] Protel 99 SE 画 PCB时，丝印层如何只显示零件位置，不显示零件参数？ PCB protel se luckay 2023-3-9 16:40 9 9745
[Quartus] Quartus II中的Waring UART gaochy1126 2023-2-28 22:35 0 6320
[Quartus] Quartus II 中 Verilog 常见警告/错误汇总 UART verilo gaochy1126 2023-2-28 22:34 1 7298
[FPGA] FPGA的管脚分配 FPGA PGA 管脚 gaochy1126 2023-2-28 22:33 3 4816
[Quartus] 如何在Quartus II中设置Virtual pin UART Virtual gaochy1126 2023-2-28 22:30 0 4398
[Quartus] 设置 Quartus II 的仿真时间大于 1us UART 仿真 gaochy1126 2023-2-28 22:29 0 4373
[Quartus] quartus II输入原理图及仿真步骤 UART 仿真 gaochy1126 2023-2-28 22:29 6 3691
[Verilog HDL] 毛刺滤除的代码应该如何写如图时钟信号 gaochy1126 2023-2-28 22:19 24 3877
[Verilog HDL] 组合逻辑电路毛刺产生原因及防止办法输出信号 gaochy1126 2023-2-28 22:17 24 3779
[Verilog HDL] Verilog中reg和wire的区别总结设计输入输出模块 gaochy1126 2023-2-28 22:15 24 3440
[Verilog HDL] Verilog中begin...end和fork....join的区别和用法 TEST Wire Input gaochy1126 2023-2-28 22:13 24 3989
[FPGA] Verilog中wire与reg类型的区别信号组合触发 gaochy1126 2023-2-28 22:11 24 3599
[CPLD] quartus ii 与 modelsim联合仿真方法 LSI SIM gaochy1126 2023-2-28 22:09 3 3176
[Quartus] Modelsim仿真设置 LSI SIM model gaochy1126 2023-2-28 22:08 4 3340
[Quartus] QUATURSII中如何与UE关联 RS gaochy1126 2023-2-28 22:05 0 2799
[Quartus] Quartus II使用入门 UART gaochy1126 2023-2-28 22:04 4 3061
pads pcb元件封装设置高度 MM 如图蜂鸣器 vitohu 2023-2-21 17:58 0 2721
[Verilog HDL] Verilog自学时序触发器 AC gaochy1126 2023-2-18 15:50 0 2829
[Verilog HDL] 关于Verilog中begin···end语句执行顺序时序逻辑时序阻塞赋值 gaochy1126 2023-2-18 15:45 0 2590
[Verilog HDL] verilog去除毛刺的方法 ST 硬件信号 gaochy1126 2023-2-18 15:39 0 2529
[Verilog HDL] verilog中的毛刺产生 se ST GS gaochy1126 2023-2-18 14:55 0 2561
[Verilog HDL] Verilog中毛刺问题时钟电平 gaochy1126 2023-2-18 14:45 0 2612
[cadence] 坐标北京，寻找兼职PCB设计 xinzhongyun 2023-2-15 23:47 0 2441
[Verilog HDL] 零基础学习Verilog verilo verilog gaochy1126 2023-1-31 22:04 26 3220
[protel] Altium Designer中的电路仿真 Altium Design Designe gaochy1126 2023-1-31 22:02 24 3219
[protel] 嘉立创EDA元件封装导入AltiumDesigner Altium AltiumDesigner Design gaochy1126 2023-1-31 22:00 24 3391
[protel] 铺铜规则 gaochy1126 2023-1-31 21:56 22 2927
[protel] 【Altium Designer】PCB如何用规则检查 Altium Design Designe gaochy1126 2023-1-31 21:55 24 2954
always语句 gaochy1126 2023-1-31 21:53 0 2661
[Verilog HDL] Verilog中的initial块 TI initial ni gaochy1126 2023-1-31 21:51 0 2639
[Verilog HDL] verilog for循环的使用 FOR FOR循环 verilo gaochy1126 2023-1-31 21:50 0 2705