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基于FPGA的H.264/AVC视频解码系统验证平台的设计
2012-5-27 19:45 0 2478
基于FPGA和视频解码芯片的实时图像采集系统设计
2012-5-27 19:42 0 2069
求解NiosII-eds安装 attach_img
2012-5-27 16:04 1 1876
“Vivado--FPGA大猜想”活动邀你参加有惊喜奖品哦!
2012-5-27 12:25 4 2536
[Quartus] 求购xilinx SP605开发板
2012-5-27 12:22 2 2805
哪能买到spartan的核心板,非开发板
2012-5-26 21:46 1 1741
[VHDL] chipscope使用问题
2012-5-26 18:47 8 2477
后仿真一个奇怪的问题 attach_img  ...2
2012-5-26 18:14 25 4215
面向动态应用的灵活操作系统
2012-5-26 18:12 3 1853
FPGA在高速互连中的应用
2012-5-26 18:10 4 2548
VGA接口设计原理 attachment
2012-5-26 17:07 2 2186
VGA接口设计原理 attachment agree
2012-5-26 17:03 1 1867
想学习串口通讯,哪位有参考代码供学习吗? attach_img  ...23
2012-5-26 10:13 43 6716
基于赛灵思spartan-3E的安全通信系统的实现
2012-5-25 16:58 1 1965
FPGA编程语言的设计 attachment
2012-5-25 16:35 3 2075
采用FPGA实现视频应用中的OSD设计
2012-5-25 15:53 2 1931
SiTime的可编程MEMS振荡器为赛灵思7系列评估套件提供参考时钟
2012-5-25 12:45 0 2327
北京博电借助Xilinx FPGA交付最新系列智能电网测试设备
2012-5-25 12:42 0 1969
基于ARM+FPGA的重构控制器设计
2012-5-25 12:00 0 2409
基于DSP和赛灵思Spartan-6的SDR系统实现
2012-5-25 11:45 0 2182
modelsim里如何添加信号 attach_img
2012-5-25 08:49 3 4158
quartus里软件仿真的数据能提取出来吗
2012-5-24 23:13 0 1442
时序违规的问题
2012-5-24 16:45 9 2695
CPLD的内部RAM怎样用呀?高人. attachment
2012-5-24 14:45 11 4014
[Quartus] 关于DDR2时序的问题,请高手帮帮忙 attach_img
2012-5-24 14:11 6 2960
HDB3 verilog
2012-5-24 10:48 0 2090
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2012-5-23 20:55 21 5060
一种基于DDS技术的通信信号的调制方法与设计 attachment
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vldh教程分享一下 attachment
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请教一个V6器件访问DDR2的问题
2012-5-23 20:39 2 2191
FPGA设计提速的几大 法宝
2012-5-23 20:28 13 3627
基于赛灵思spartan-3 的DSP嵌入系统及其在平板显示器中的应用
2012-5-23 20:25 12 3165
关于PROM的使用
2012-5-23 09:58 2 1575
项目前期怎么确定FPGA/CPLD芯片容量?
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招聘:赛灵思两个职位空缺-北上广任你选
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[matlab] xilinx的ISE下载
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VHDL+Verilog良好的代码编写风格(二十五条)
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信号完整性和时序分析的模式变化 attachment
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直接从C代码自动寻找和创建加速器 attachment
2012-5-22 15:54 2 2277
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