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请教两个关于LVDS的问题 LVDS cyclone 总线 chinaitboy 2014-9-19 23:16 1 1083
[verilog] 请教双向端口顶层与底层连接的逻辑设计逻辑设计双向端口 os 502593045 2014-9-18 23:14 2 1210
[verilog] 在读写ddr2的时候，DQS信号怎么用，可不可以不用 DDR 信号读写天河系的星星 2014-9-18 23:03 4 2405
用FPGA做FFT，是否一定需要高数基础才行。 fft FPGA PGA wajtmusic 2014-9-18 16:48 6 2269
spi flash双速率读取求解 flash pi 飞翔de蜗牛 2014-9-17 22:29 0 849
[FPGA] dsp的flash上电不加载 DSP flash spartan hjz07091982 2014-9-17 22:18 0 996
[Quartus] quartus 13.1字符串快速输入字符串布川酷子 2014-9-17 14:33 1 1175
再发一帖求助，50分求助，还是这个蛋疼的JTAG接口，Altera的 altera JTAG接口短路 wjddyj 2014-9-17 14:30 5 1937
[FPGA] FPGA和TMS320C6455之间的通信 FPGA 通信 tms320c6455 DGpengge 2014-9-17 13:47 1 929
timequest 中set input delay ,set output delay,怎么设置 se Input Output side8666 2014-9-17 13:41 0 1486
[FPGA] 最近找工作，比较迷茫，求指点 FPGA PGA 图像处理 aikimi7 2014-9-17 12:18 8 1518
成功解决FPGA设计时序问题的三大要点时序 FPGA设计时钟 LMQQ 2014-9-16 22:36 14 1903
[FPGA] 《自己动手写CPU》下载指令 ip leon1984 2014-9-15 19:53 1 1063
[FPGA] fifo设计 FIFO FPGA PGA hkl_02 2014-9-13 10:32 0 707
[verilog] 基于FPGA的示波器图文显示系统的设计方案示波器 FPGA 显示系统 lzmm 2014-9-12 11:46 4 2259
[verilog] 我与赛灵思的2012+菜鸟也分享赛灵思 ST ic gygp 2014-9-12 11:44 18 2719
[verilog] 基于FPGA实现的可复用通信接口设计通信接口接口设计 FPGA实现 kkzz 2014-9-12 11:43 4 2505
[verilog] 自定义ram问题 FPGA contro sen19890606 2014-9-12 11:24 5 3717
[FPGA] 如何修正时序约束中slack为负的问题 AC ck 时序 3008202060 2014-9-11 21:41 3 2286
赛灵思领域专用目标设计平台背景介绍赛灵思 FPGA PGA xjsxjtu 2014-9-11 17:43 1 1137
Proteus 与单片机实时动态仿真 Proteus 单片机实时动态仿真星星之火红 2014-9-11 16:53 14 9866
设计技巧：基于赛灵思Spartan-3A DSP的安全视频分析 DSP spartan-3a 赛灵思 xjsxjtu 2014-9-11 16:52 3 1494
iccavr 和avr studio安装调试总结调试 Studio 飞鹰嵌入式 2014-9-11 16:51 1 2947
基于EDK的FPGA算法开发总结 FPGA pc 硬件星星之火红 2014-9-11 15:45 3 2192
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